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016-Verilog

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20门 系列课程
芯片设计与FPGA 所属方向
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01
《AXI4互连总线设计与系统集成》
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02
《AXI互连功能覆盖与验证工程实践》
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03
《AXI互连时序收敛技巧实战》
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04
《FPGA上板联调常见问题解决实战》
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05
《FPGA功能覆盖与验证方法》
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06
《FPGA开发之按键消抖与上板实战》
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07
《SerDes误码测试与调试实战》
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08
《SerDes高速接口设计入门》
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09
《Verilog入门到串口收发实战》
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10
《Verilog时序收敛与上板调试实战》
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11
《Vitis与Verilog联调实战：软硬件协同开发从入门到精通》
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12
《Vitis环境下FPGA开发实战》
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13
《串口接收模块流水线改造实战课程》
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14
《从串口到SerDes接口进阶》
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15
《从按键消抖理解状态机设计》
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16
《卷积加速器RTL设计与优化》
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17
《卷积加速器时序收敛策略实战》
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18
《流水线设计加速卷积运算实战》
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19
《流水线设计：提升系统吞吐率工程实践》
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20
《误码测试与链路可靠性分析》
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