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216-Cadence Allegro高速PCB设计工程
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《Allegro SerDes高速链路设计工程》
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本课程属于:216-Cadence Allegro高速PCB设计工程
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Allegro SerDes高速链路设计工程
共计 30 章节
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01
SerDes高速链路设计工程导入
目标=课程目标 · Allegro设计流程定位 · SerDes链路组成
SerDes
高速链路设计工程…
02
SerDes信号与通道基础
目标=NRZ/PAM4调制 · 差分信号 · 通道损耗
SerDes
信号
03
Allegro高速设计环境搭建
目标=Constraint Mana… · Cross-section · Padstack
Allegro
高速设计环境搭建
04
高速叠层与阻抗设计
目标=材料选型 · 铜箔粗糙度 · 介质厚度
高速叠层
阻抗设计
05
SerDes器件与封装模型导入
目标=IBIS-AMI模型 · 封装参数 · Die模型
SerDes
器件
06
高速连接器与过孔设计
目标=连接器选型 · 过孔stub · 背钻
高速连接器
过孔设计
07
AC耦合与端接网络设计
目标=AC耦合电容选型与布局 · 端接电阻 · 偏置网络
AC
耦合
08
SerDes差分对布线规则
目标=差分对创建 · 等长匹配 · 间距控制
SerDes
差分对布线规则
09
通道拓扑与长度匹配
目标=点对点 · Fly-by · 中继器拓扑
通道拓扑
长度匹配
10
参考平面与回流路径设计
目标=平面分割 · 跨分割处理 · 回流过孔
参考平面
回流路径设计
11
电源完整性对SerDes的影响
目标=PDN阻抗 · 电源噪声 · 去耦电容布局
SerDes
电源完整性对
12
过孔与连接器S参数提取
目标=3D电磁提取流程 · 端口设置 · 去嵌
过孔
连接器S参数提取
13
通道S参数与链路预算
目标=插入损耗 · 回波损耗 · 串扰
通道S参数
链路预算
14
IBIS-AMI仿真与眼图分析
目标=AMI模型配置 · TX/RX均衡 · 通道仿真
IBIS-AMI
仿真
15
均衡与自适应技术
目标=FFE · CTLE · DFE
均衡
自适应技术
16
抖动与噪声分析
目标=随机抖动 · 确定性抖动 · 总抖动
抖动
噪声分析
17
串扰分析与抑制
目标=近端/远端串扰 · 攻击线选择 · 防护布线
串扰分析
抑制
18
阻抗不连续与反射优化
目标=过孔 · 连接器 · AC电容
阻抗不连续
反射优化
19
SerDes通道仿真与IBIS-AMI实战
目标=搭建端到端通道 · 配置AMI参数 · 运行仿真
SerDes
IBIS-AMI
20
Allegro约束驱动布线实战
目标=从Constraint Man… · 差分对 · 等长组
Allegro
约束驱动布线实战
21
高速链路PCB布局实战
目标=器件摆放 · 通道走向 · 连接器扇出
PCB
高速链路
22
SerDes链路调试与测量
目标=眼图测试 · TDR/TDT · S参数测量
SerDes
链路调试
23
通道裕量评估与设计迭代
目标=仿真与实测对比 · 通道裕量分析 · 设计优化
通道裕量评估
设计迭代
24
多通道与高密度SerDes设计
目标=通道间隔离 · 连接器密度 · 过孔阵列
SerDes
多通道
25
背板与电缆SerDes链路设计
目标=背板通道 · 电缆组件 · 连接器过渡
SerDes
背板
26
SerDes电源与时钟协同设计
目标=参考时钟抖动 · 时钟布线 · 电源噪声耦合
SerDes
电源
27
热设计与机械协同
目标=高速连接器散热 · PCB热应力 · 材料膨胀
热设计
机械协同
28
设计规则检查与制造输出
目标=Allegro DRC · DFM · 阻抗测试报告
设计规则检查
制造输出
29
SerDes链路故障排查案例
目标=常见失效模式 · 眼图闭合 · 误码
SerDes
链路故障排查案例
30
综合项目
目标=完整SerDes链路设计工程 · 叠层规划 · 约束设置
综合项目
SerDes
所属VIP或分类
同VIP:Allegro-DDR-SI仿真与布线优化
同VIP:Allegro-DDR高速存储板设计
同VIP:Allegro-DFM与制造可测性协同