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RISC-V软核SoC集成调试优化实战工程

共计 30 章节
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01
课程导入
目标=RISC-V软核SoC集成调试… · 核心概念 · 整体框架与实战路线图
课程导入RISC-V
02
RISC-V指令集与软核基础
目标=RV32I/RV64I · M/A/F/D/C扩展 · 特权模式
RISC-V指令集
03
主流RISC-V软核选型对比
目标=Rocket Chip · BOOM · CVA6
RISC-V主流
04
SoC总线与互连协议
目标=AXI4 · AHB · APB
SoC总线
05
存储子系统集成
目标=指令/数据Cache · TCM · DDR控制器
存储子系统集成Cache
06
外设与中断控制器集成
目标=UART · SPI · I2C
外设断控制器集成
07
时钟、复位与电源管理
目标=时钟树综合 · 跨时钟域处理 · 复位同步
时钟复位
08
FPGA原型验证流程
目标=综合 · 布局布线 · 时序约束
FPGA原型验证流程
09
仿真验证环境搭建
目标=Verilator · VCS · Icarus
仿真验证环境搭建Verilator
10
调试架构与接口
目标=JTAG · RISC-V Debug Speci… · DM
调试架构接口
11
硬件断点与观察点
目标=触发模块 · 断点类型 · 单步执行
硬件断点观察点
12
Trace与性能计数器
目标=指令Trace · 分支Trace · 性能事件
Trace性能计数器
13
启动流程与Bootloader
目标=复位向量 · BootROM · SPL
Bootloader启动流程
14
操作系统与运行时支持
目标=裸机 · FreeRTOS · Zephyr
操作系统运行时支持
15
工具链与软件开发
目标=GCC · LLVM · Binutils
工具链软件开发
16
集成调试实战一
目标=搭建最小RISC-V软核SoC… · 完成仿真与FPGA上板验证
集成调试实战一RISC-V
17
集成调试实战二
目标=集成UART与中断控制器 · 实现串口交互与定时器中断调试
集成调试实战二UART
18
集成调试实战三
目标=集成DDR与Cache · 运行CoreMark与Dhrysto…
集成调试实战三DDR
19
集成调试实战四
目标=使用JTAG与OpenOCD进… · 设置断点 · 查看寄存器和内存
集成调试实战四JTAG
20
集成调试实战五
目标=移植FreeRTOS或Zeph… · 调试任务调度 · 上下文切换与中断延迟
集成调试实战五FreeRTOS
21
集成调试实战六
目标=移植Linux内核与根文件系统 · 调试启动失败 · 驱动加载与用户态程序
集成调试实战六Linux
22
性能优化方法
目标=流水线优化 · 分支预测 · Cache优化
性能优化方法目标=流水线优化
23
面积与功耗优化
目标=逻辑综合优化 · 门控时钟 · 操作数隔离
面积功耗优化
24
时序收敛与物理实现
目标=时序分析 · 关键路径优化 · 跨时钟域约束
时序收敛物理实现
25
常见集成问题排查
目标=总线死锁 · 地址冲突 · 中断丢失
常见集成问题排查目标=总线死锁
26
常见调试问题排查
目标=JTAG连接失败 · GDB无法挂载 · 断点不生效
常见调试问题排查JTAG
27
验证与回归测试
目标=单元测试 · 集成测试 · 系统测试
验证回归测试
28
安全与可靠性增强
目标=安全启动 · TrustZone · ECC
安全可靠性增强
29
综合项目实战
目标=从需求到量产 · 完成一个RISC-V软核SoC的集成 · 调试
综合项目实战目标=从需求到量…
30
课程总结与进阶路线
目标=知识体系回顾 · 工程经验提炼 · 开源社区资源
课程总结进阶路线