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PCIe Gen3均衡训练与CDR锁定联合调试

共计 30 章节
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01
PCIe链路训练概述
链路训练状态机（LTSSM）基本概念…
PCIe链路训练概述
02
Gen3速率协商背景
从Gen1/Gen2到Gen3的演进 · Gen3 8GT/s速率带来的挑战
Gen3速率协商背景
03
LTSSM状态详解
Detect · Polling · Configuration
LTSSM状态详解
04
Gen3速率协商入口
从Gen2速率进入Recovery状… · 发起速率变更请求
Gen3速率协商入口
05
Equalization（均衡）过程
Gen3必须的Tx/Rx均衡 · Pre-cursor · Post-cursor
Equalization均衡
06
Phase 1
均衡协商启动 · 发送TS1/TS2有序集
Phase1
07
Phase 2
Tx均衡系数更新 · 调整发送端去加重/摆幅
Phase2
08
Phase 3
Rx均衡与最终锁定 · 锁定时钟
Phase3
09
时钟恢复基础
CDR（时钟数据恢复）原理 · PLL与相位插值器
时钟恢复基础CDR
10
Gen3时钟架构
Common Clock vs. S…
Gen3时钟架构
11
SSC对时钟恢复的影响
扩频时钟的调制率与调制深度 · 跟踪带宽要求
SSC对时钟恢复的影响
12
CDR锁定过程
频率捕获 · 相位跟踪 · 锁定检测
CDR锁定过程
13
Gen3数据编码
128b/130b编码 · 与Gen1/Gen2的8b/10b编…
Gen3数据编码
14
Scrambling（扰码）与时钟恢复
扰码对数据转换密度的影响 · CDR对长连0/1的容忍度
Scrambling扰码
15
SKP有序集与时钟补偿
SKP插入/删除机制 · 弹性缓冲区的管理
SKP有序集
16
Gen3链路训练失败常见原因
均衡系数不匹配 · CDR失锁 · 信号完整性差
Gen3链路训练失败常见…
17
调试工具与方法
逻辑分析仪 · 示波器 · PCIe协议分析仪的使用
调试工具逻辑分析仪
18
LTSSM状态跟踪
通过寄存器读取（如LTSSM Sta…
LTSSM状态跟踪
19
均衡系数调试
读取/写入TxEQ寄存器 · 手动调整系数
均衡系数调试TxEQ
20
CDR锁定状态监测
读取CDR锁定状态寄存器 · 分析锁定失败原因
CDR锁定状态监测
21
眼图分析
Gen3眼图模板 · 眼高 · 眼宽
眼图分析Gen3
22
抖动分离
随机抖动（RJ） · 确定性抖动（DJ） · 周期抖动（PJ）对链路的影响
抖动分离RJ
23
Gen3链路预算
插入损耗 · 回波损耗 · 串扰对速率协商的影响
Gen3链路预算
24
PCB设计对时钟恢复的影响
走线长度匹配 · 参考层连续 · 过孔设计
PCB设计对时钟恢复的…
25
Gen3 Retimer/Redriver的作用
时钟恢复与均衡的硬件辅助
Gen3Retimer/Redr…
26
案例1
Gen3链路无法协商到8GT/s · 卡在Recovery状态
案例1Gen3
27
案例2
链路协商成功但误码率高 · CDR频繁失锁
案例2链路协商成功但误…
28
案例3
SSC导致时钟跟踪失败 · 链路降速到Gen2
案例3SSC
29
Gen4/Gen5速率协商展望
更高速率下的均衡与时钟恢复挑战
Gen4/Gen5速率协商展望
30
课程总结与最佳实践
Gen3链路调试Checklist与…
课程总结最佳实践