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022-DDR5信号完整性与仿真
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《基于实际项目的DDR5信号完整性案例》
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基于实际项目的DDR5信号完整性案例
共计 30 章节
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01
DDR5概述与规格演进
介绍DDR5相比DDR4的性能提升 · JEDEC标准定义 · 以及实际项目中DDR5选型考虑因素
DDR5
规格演进
02
DDR5信号完整性挑战概述
分析DDR5高数据速率下信号完整性的… · 包括眼图闭合 · 时序窗口缩小
DDR5
信号完整性挑战概…
03
传输线理论在DDR5中的应用
回顾均匀传输线 · 特性阻抗 · 反射系数等基础
DDR5
传输线理论
04
DDR5接口拓扑与架构
介绍DDR5的DQ · DQS · CMD/ADDR
DDR5
接口拓扑
05
高速信号的反射与端接
基于实际项目案例 · 分析DDR5走线中的反射产生机制 · 以及串联/并联端接策略
高速信号的反射
端接
06
串扰分析与缓解技术
探讨DDR5相邻信号的串扰机理 · 通过一个DDR5模块的串扰仿真案例展…
串扰分析
缓解技术
07
电源完整性(PI)基础与DDR5
说明DDR5对电源噪声的敏感度 · 去耦电容的选择与布局对信号完整性的影…
PI
DDR5
08
阻抗控制与PCB叠层设计
介绍DDR5要求的单端/差分阻抗目标 · 以及叠层设计中的实际工程案例
PCB
阻抗控制
09
眼图测量与裕量分析
解释眼图参数(眼高 · 眼宽 · 抖动)在DDR5中的应用
眼图测量
裕量分析
10
DDR5时序参数与JEDEC规范
详细解读DDR5的关键时序参数(如t… · tRCD · tRP等)
DDR5
JEDEC
11
实际项目案例
服务器DDR5内存通道设计 · 介绍通道规划 · 布局约束与仿真验证流程
实际项目案例
DDR5
12
IBIS-AMI模型在DDR5仿真中的应用
讲解IBIS-AMI模型原理 · 以及如何使用模型进行DDR5通道仿真
IBIS-AMI
DDR5
13
仿真工具(ADS/HFSS/Sigrity)实操
对比主流仿真工具 · 结合一个DDR5通道仿真步骤演示
ADS/HFSS/Sig…
仿真工具
14
DDR5内存控制器布局要点
介绍控制器与DRAM之间的布局原则 · 包括等长布线 · 分组约束等
DDR5
内存控制器布局要…
15
过孔设计与回流路径优化
分析过孔阻抗不连续对DDR5信号的影… · 通过实际案例展示过孔背钻和回流路径改…
过孔设计
回流路径优化
16
差分信号设计与DDR5 DQS
讲解差分对布线规则 · 等长要求 · 以及DQS与DQ的相对时延控制
DDR5
DQS
17
DDR5 Training机制与SI关联
解释DDR5的读写训练过程(如ZQ校… · DLL锁定) · 以及训练失败时的信号完整性根因
DDR5
Training
18
同步开关噪声(SSN)分析与抑制
基于DDR5并行总线案例 · 分析SSN对信号眼图的影响及去耦方案
SSN
同步开关噪声
19
温度与电压变化对DDR5信号的影响
通过仿真和实测 · 展示温度和电压波动对时序和眼图裕量的…
DDR5
温度
20
测试与验证
TDR测量 · 以及如何解析TDR波形
测试
验证
21
测试与验证
眼图测量实测案例 · 对比仿真与实测结果 · 分析误差来源
测试
验证
22
调试案例
阻抗不匹配导致的信号反射
调试案例
阻抗不匹配导致的…
23
调试案例
串扰导致的DQS抖动
调试案例
DQS
24
协同仿真
SI与PI联合分析方法 · 以DDR5控制器PDN为例
协同仿真
SI
25
布局布线检查清单与设计规则
基于实际项目经验 · 总结DDR5设计的PCB布局布线规则…
布局布线检查清单
设计规则
26
可靠性测试与裕量折损
介绍DDR5信号完整性裕量随温度老化… · 以及寿命评估
可靠性测试
裕量折损
27
DDR5封装设计对SI的影响
分析封装基板中的信号完整性挑战 · 如BGA球栅寄生参数 · 封装走线等
DDR5
SI
28
高级话题
DDR5双倍数据速率下的均衡技术
高级话题
DDR5
29
实际项目案例
手机DDR5布局优化 · 分享DDR5布局布线的折衷与优化策略
实际项目案例
DDR5
30
课程总结与未来趋势
回顾DDR5信号完整性核心要点 · 展望DDR6及更高速度下的SI挑战与…
课程总结
未来趋势
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