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OpenROAD 后端案例解析教程

共计 30 章节
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01
OpenROAD 初探
什么是 OpenROAD？开源数字后… · OpenROAD 的安装与验证
OpenROAD初探
02
设计输入与准备
Verilog 网表解析 · Liberty 库文件格式 · LEF/DEF 文件介绍
设计输入准备
03
综合入门
Yosys 与 OpenROAD 的… · 逻辑综合基本概念 · 综合策略与脚本编写
综合入门Yosys
04
综合进阶
时序约束（SDC）编写 · 综合优化技巧 · 面积与速度的权衡
综合进阶SDC
05
布局规划（Floorplanning）
芯片面积估算 · IO Pad 规划 · 宏单元（Macro）摆放
Floorplannin…布局规划
06
电源网络设计
电源环（Power Ring）与电源… · 电源域划分 · IR Drop 分析基础
电源网络设计Power
07
标准单元布局（Placement）
全局布局与详细布局 · 拥塞度分析 · 布局优化策略
Placement标准单元布局
08
时钟树综合（CTS）
时钟树概念 · 时钟偏差与时钟抖动 · OpenROAD 中的 CTS 流程
CTS时钟树综合
09
布线（Routing）
全局布线（Global Routin… · 布线规则设置 · 天线效应修复
Routing布线
10
静态时序分析（STA）基础
OpenSTA 集成 · 建立时间与保持时间检查 · 时序路径分类
STA静态时序分析
11
静态时序分析（STA）进阶
多模式多角（MMMC）分析 · 片上变异（OCV）处理 · 时序例外（False Path/Mu…
STA静态时序分析
12
物理验证（Physical Verification）
DRC 检查基础 · 天线规则检查 · 金属密度检查
PhysicalVerification
13
功耗分析
动态功耗与静态功耗 · 功耗分析流程 · 低功耗设计技术（时钟门控
功耗分析动态功耗
14
可制造性设计（DFM）
CMP 效应与 dummy fill · 金属层均匀性 · 通孔优化
DFM可制造性设计
15
层次化设计（Hierarchical Design）
模块划分 · 顶层与模块的接口时序 · 黑盒（Black Box）处理
HierarchicalDesign
16
Tcl 脚本与自动化
OpenROAD Tcl 命令详解 · 流程自动化脚本编写 · 参数化设计
Tcl脚本
17
设计约束管理
综合约束 · 布局约束 · 布线约束
设计约束管理综合约束
18
多电压域设计
电压域划分 · 电平转换器（Level Shifte… · 隔离单元（Isolation Cel…
多电压域设计电压域划分
19
扫描链插入与测试
可测性设计（DFT）基础 · 扫描链（Scan Chain）插入 · ATPG 测试向量生成
扫描链插入测试
20
ECO（工程变更单）流程
功能 ECO 与时序 ECO · ECO 布线 · ECO 验证
ECO工程变更单
21
GDSII 输出与流片准备
GDSII 文件生成 · 流片前检查清单 · 设计规则检查（DRC）最终签核
GDSII输出
22
OpenROAD 与其他 EDA 工具的集成
与商业工具的数据交换 · 标准格式（SDC/LEF/DEF）兼… · 混合流程搭建
OpenROADEDA
23
机器学习在物理设计中的应用
拥塞预测 · 时序预测 · 布局优化中的 ML 方法
机器学习物理设计
24
开源 PDK 与工艺库
SkyWater 130nm PDK… · PDK 安装与配置 · 工艺角（PVT Corner）设置
PDK开源
25
RTL-to-GDSII 完整流程实战（上）
从 RTL 到布局规划 · 综合与 Floorplan 实战 · 标准单元布局实战
RTL-to-GDSII完整流程实战
26
RTL-to-GDSII 完整流程实战（中）
时钟树综合实战 · 布线实战 · 时序与功耗优化实战
RTL-to-GDSII完整流程实战
27
RTL-to-GDSII 完整流程实战（下）
物理验证实战 · GDSII 输出与签核 · 设计回顾与总结
RTL-to-GDSII完整流程实战
28
常见问题与调试技巧
综合不收敛怎么办？布线拥塞如何解决？…
常见问题调试技巧
29
性能优化与最佳实践
运行时间优化 · 内存管理 · 并行化策略
性能优化最佳实践
30
未来展望与社区生态
OpenROAD 项目路线图 · 开源 EDA 社区贡献 · 从开源到商业化的思考
未来展望社区生态