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《拥塞分析进阶技巧分享》
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拥塞分析进阶技巧分享
📚 共计 30 章节
01
拥塞分析基础回顾
什么是拥塞?为什么拥塞是先进制程的噩梦?
基础
概念
02
全局与局部拥塞
全局拥塞 vs 局部拥塞,谁才是真正的杀手?
对比
核心
03
工艺节点对拥塞的影响
从7nm到3nm,拥塞为何越来越严重?
工艺
趋势
04
标准单元库与拥塞
库的驱动强度、面积与引脚密度如何影响绕线?
库
设计
05
Floorplan与拥塞
一个糟糕的Floorplan如何引发全局拥塞?
布局
规划
06
Pin Access与拥塞
为什么我的Pin Access总是爆红?
引脚
访问
07
Macro Placement与拥塞
大模块的摆放艺术与绕线通道的博弈。
宏单元
布局
08
Power Grid与拥塞
电源网络如何成为拥塞的隐形推手?
电源
网格
09
综合策略与拥塞
逻辑综合阶段如何预判并缓解拥塞?
综合
策略
10
时钟树综合与拥塞
时钟树是如何成为局部拥塞的重灾区的?
时钟
CTS
11
布线层分配策略
如何合理分配金属层以平衡拥塞?
层分配
金属
12
布线方向与拥塞
为什么交替布线方向能救你一命?
方向
技巧
13
布线轨道与通孔
轨道对齐与通孔插入对拥塞的微妙影响。
轨道
通孔
14
拥塞热点分析
如何精准定位并分析拥塞热点?
热点
诊断
15
拥塞地图解读
读懂EDA工具给你的拥塞报告。
地图
报告
16
基于GR的拥塞预估
全局绕线阶段的拥塞预估与修复。
GR
预估
17
基于DR的拥塞修复
详细绕线阶段的拥塞修复技巧。
DR
修复
18
Cell Spreading与拥塞
如何通过分散标准单元来缓解拥塞?
扩散
单元
19
Cell Padding与拥塞
给单元加“缓冲带”的艺术。
填充
间距
20
Gate Sizing与拥塞
通过调整单元尺寸来释放绕线空间。
尺寸
优化
21
逻辑等价性检查与拥塞修复
如何在不改功能的前提下优化拥塞?
LEC
等价
22
层次化设计与拥塞
Top-down vs Bottom-up,哪种方法更优?
层次
设计
23
拥塞驱动的布局
如何让布局工具优先考虑拥塞?
布局
驱动
24
拥塞驱动的时钟树综合
让时钟树绕开拥塞区域。
时钟
绕线
25
拥塞驱动的布线
如何引导布线器避开雷区?
布线
引导
26
填充单元与拥塞
金属填充对拥塞的利与弊。
填充
金属
27
ECO与拥塞修复
如何在后期快速修复拥塞问题?
ECO
修复
28
脚本自动化拥塞分析
用Tcl/Python脚本批量处理拥塞报告。
脚本
自动化
29
案例分析:7nm芯片拥塞修复
一个7nm芯片的拥塞修复全过程。
案例
7nm
30
未来趋势:AI与机器学习
AI与机器学习在拥塞分析中的应用展望。
AI
趋势
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