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182-Chiplet与3D封装协同设计
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《Chiplet物理设计EDA工具链》
VIP7
本课程属于:182-Chiplet与3D封装协同设计
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Chiplet物理设计EDA工具链从入门到精通
共计 30 章节
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01
课程导入
Chiplet技术背景 · 物理设计EDA工具链的定位与价值 · 课程学习路径与目标
课程导入
Chiplet
02
Chiplet基础概念
Chiplet架构 · 异构集成 · 5D/3D封装
Chiplet
基础概念
03
物理设计EDA工具链全景
从RTL到GDSII的完整流程 · 工具分类(综合 · 布局布线
EDA
物理设计
04
Chiplet物理设计挑战
多芯片协同设计 · 跨芯片时序收敛 · 热-应力-翘曲耦合
Chiplet
物理设计挑战
05
Chiplet设计输入与网表准备
多芯片网表划分 · 接口逻辑建模 · Die间互连描述
Chiplet
设计输入
06
Chiplet布局规划
多Die布局策略 · 硅中介层/扇出型封装布局 · 引脚分配
Chiplet
布局规划
07
Chiplet布线技术
全局布线 · 详细布线 · Die间布线(RDL/TSV/微凸点…
Chiplet
布线技术
08
时钟树综合与同步
多Die时钟分配 · 跨Die时钟同步 · 时钟偏斜与抖动
时钟树综合
同步
09
电源网络设计
多Die电源域划分 · IR压降分析 · 电迁移
电源网络设计
Die
10
信号完整性分析
传输线效应 · 串扰 · 反射
信号完整性分析
传输线效应
11
热分析与热管理
多Die热模型 · 热源分布 · 热阻网络
热分析
热管理
12
机械应力与翘曲分析
封装应力来源 · 翘曲预测 · 材料属性
机械应力
翘曲分析
13
Chiplet物理验证
DRC/LVS · 跨Die一致性检查 · 金属密度检查
Chiplet
物理验证
14
时序分析与收敛
多Die时序约束 · 跨Die路径时序 · 片上变异
时序分析
收敛
15
功耗分析与优化
动态/静态功耗 · 多Die功耗分配 · 功耗预算
功耗分析
优化
16
Chiplet设计规则检查
封装级设计规则 · 微凸点/TSV规则 · RDL规则
Chiplet
设计规则检查
17
开源工具链实践
OpenROAD · KLayout · Magic
开源工具链实践
OpenROAD
18
商业工具链实践
Synopsys/Cadence/S…
商业工具链实践
Synopsys/Cad…
19
Chiplet物理设计脚本与自动化
Tcl/Python脚本编写 · 设计流程自动化 · 数据管理
Chiplet
物理设计脚本
20
案例实战
基于UCIe接口的双Die Chip…
案例实战
UCIe
21
案例实战
3D Chiplet设计(TSV集成…
案例实战
Chiplet
22
案例实战
异构Chiplet(逻辑+存储+模拟…
案例实战
Chiplet
23
Chiplet物理设计中的DFT
扫描链跨Die · 边界扫描 · 内建自测试
Chiplet
DFT
24
Chiplet可制造性与良率提升
工艺窗口 · 缺陷分析 · 冗余设计
Chiplet
可制造性
25
Chiplet物理设计中的可靠性
老化效应 · 静电放电 · 闩锁效应
Chiplet
物理设计
26
Chiplet物理设计数据管理与协同
多团队并行设计 · 数据交换格式(LEF/DEF/GDS… · 设计数据库
Chiplet
物理设计数据管理
27
Chiplet物理设计中的机器学习应用
布局布线优化 · 时序预测 · 热预测
Chiplet
物理设计
28
Chiplet物理设计工具链的评估与选型
功能对比 · 性能基准 · 成本考量
Chiplet
物理设计工具链的…
29
常见问题与调试技巧
布局布线失败 · 时序违例 · DRC错误
常见问题
调试技巧
30
综合提升与未来趋势
Chiplet物理设计最佳实践 · 工具链演进方向 · 与系统级协同设计
综合提升
未来趋势
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