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全额支付Chiplet高速接口112G SerDes设计与验证

共计 30 章节
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01
课程导入
学习目标 · 课程大纲 · Chiplet与112G SerDe…
课程导入学习目标
02
SerDes基础
高速串行接口的基本原理 · 架构组成 · 关键性能指标（速率
SerDes高速串行接口的基…
03
Chiplet技术概述
Chiplet定义 · 封装形式（2.5D/3D） · UCIe标准与112G SerDes…
Chiplet技术概述
04
112G SerDes标准体系
IEEE 802.3ck · OIF CEI-112G · PCIe 6.0等标准的关键规范与差…
SerDes112G
05
SerDes物理层设计
TX/RX电路架构 · PLL/CDR · 均衡技术（CTLE/DFE/FFE）…
SerDes物理层设计
06
高速信道建模
信道损耗 · 串扰 · 反射
高速信道建模信道损耗
07
信号完整性基础
S参数 · 眼图 · 浴盆曲线
信号完整性基础S参数
08
112G SerDes关键设计挑战
奈奎斯特频率损耗 · 功耗约束 · 封装寄生效应
SerDes112G
09
SerDes数字信号处理
DSP架构 · 均衡算法（LMS/RLS） · 前向纠错（FEC）在112G中的应用
SerDes数字信号处理
10
TX设计实战
高速驱动器的电路拓扑 · 阻抗匹配 · 预加重/去加重实现与仿真
TX设计实战
11
RX设计实战
接收机前端 · 自适应均衡器 · 时钟恢复环路的设计与仿真
RX设计实战
12
PLL与时钟生成
低抖动PLL设计 · 锁相环带宽优化 · 时钟分配网络
PLL时钟生成
13
CDR设计
相位插值器 · 数字CDR算法 · 锁定检测与环路稳定性
CDR设计
14
SerDes验证方法论
验证计划 · 验证环境搭建 · 覆盖率驱动验证（UVM）在SerDe…
SerDes验证方法论
15
模拟验证技术
SPICE仿真 · 瞬态/交流/噪声分析 · 蒙特卡洛仿真在SerDes验证中的使…
模拟验证技术SPICE
16
数字验证技术
RTL仿真 · 协议一致性测试 · 断言验证（SVA）在SerDes控制…
数字验证技术RTL
17
混合信号验证
AMS验证流程 · 数模协同仿真 · 行为级模型与晶体管级混合验证
混合信号验证AMS
18
112G SerDes测试方案
高速示波器 · 误码仪 · TDR/VNA等测试设备的使用与测试…
SerDes112G
19
一致性测试与合规性
针对IEEE/OIF标准的电气测试 · 协议测试 · 测试夹具设计
一致性测试合规性
20
Chiplet互连验证
UCIe物理层验证 · 多芯片系统级验证 · 封装内互连测试
Chiplet互连验证
21
案例实战
基于UVM的112G SerDes数…
案例实战UVM
22
案例实战
模拟前端电路设计与验证 · 从规格到版图后仿真的完整流程
案例实战模拟前端电路设计
23
案例实战
信道仿真与均衡器参数优化 · 使用Python/Matlab进行链…
案例实战信道仿真
24
案例实战
112G SerDes测试平台搭建与… · 包括眼图 · 抖动
案例实战SerDes
25
常见问题与调试技巧
信号完整性问题定位 · 时钟失锁 · 均衡收敛失败等故障排查
常见问题调试技巧
26
功耗与可靠性设计
低功耗技术 · ESD保护 · 可靠性验证（老化
功耗可靠性设计
27
可测试性设计（DFT）
BIST · 环回测试 · 扫描链在SerDes中的应用
DFT可测试性设计
28
先进工艺与封装影响
FinFET/纳米片工艺对SerDe… · 先进封装对信号完整性的挑战
先进工艺封装影响
29
综合提升
从单芯片SerDes到Chiplet… · 如何权衡性能 · 功耗
综合提升SerDes
30
课程总结与项目实战
综合项目设计（如Chiplet接口子… · 答辩与评估
课程总结项目实战