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本课程属于：132-RISC-V处理器核微架构设计 嵌入式基础与RISC-V · 共 10 门相关课程，组合学习更完整。
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RISC-V处理器核性能调优与功耗优化实战

共计 30 章节
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01
RISC-V基础与架构概览
RISC-V指令集架构设计哲学 · 模块化特性 · 特权架构与用户架构
RISC-V架构概览
02
处理器微架构入门
经典5级流水线 · 数据通路与控制逻辑 · 哈佛与冯诺依曼结构
处理器微架构入门经典5级流水线
03
性能指标与基准测试
IPC · CPI · 主频
性能指标基准测试
04
流水线冒险与解决
结构冒险 · 数据冒险（前递/旁路） · 控制冒险（分支预测）
流水线冒险解决
05
分支预测技术
静态预测 · 动态预测（2位饱和计数器 · BTB
分支预测技术静态预测
06
缓存架构基础
Cache层次结构 · 直接映射/组相联/全相联 · 写策略（写直达/写回）
缓存架构基础Cache
07
缓存性能优化
命中率 · 缺失率 · 缺失惩罚
缓存性能优化命中率
08
内存管理单元
虚拟地址与物理地址 · 页表 · TLB设计与优化
内存管理单元虚拟地址
09
超标量架构
多发射 · 指令窗口 · 重排序缓冲
超标量架构多发射
10
乱序执行
寄存器重命名 · Tomasulo算法 · 提交与退休
乱序执行寄存器重命名
11
功耗基础
动态功耗（开关功耗） · 静态功耗（漏电流） · 电压与频率关系
功耗基础动态功耗
12
时钟门控技术
组合逻辑时钟门控 · 寄存器时钟门控 · 自动门控插入
时钟门控技术组合逻辑时钟门控
13
电源门控
电源开关 · 状态保持 · 唤醒延迟与功耗权衡
电源门控电源开关
14
多电压域设计
电压岛 · 动态电压频率调整 · 自适应电压调节
多电压域设计电压岛
15
RTL级低功耗设计
操作数隔离 · 资源共享 · 状态机编码优化
RTL级低功耗设计
16
综合与逻辑优化
综合策略 · 时序驱动综合 · 面积与功耗权衡
综合逻辑优化
17
静态时序分析
建立时间 · 保持时间 · 时序路径
静态时序分析建立时间
18
功耗分析工具
PrimePower · SpyGlass Power · 功耗仿真流程
功耗分析工具PrimePower
19
RISC-V开源核实战
Rocket Chip · BOOM · SweRV EH1核架构分析
RISC-V开源核实战
20
性能计数器与剖析
硬件性能计数器 · Perf工具 · 性能瓶颈定位
性能计数器剖析
21
编译器优化
GCC/LLVM优化选项 · 循环展开 · 内联
编译器优化GCC/LLVM
22
指令集扩展
RISC-V向量扩展 · 位操作扩展 · 自定义协处理器
指令集扩展RISC-V
23
多核与一致性
缓存一致性协议（MESI · MOESI） · 内存一致性模型
多核一致性
24
互连与片上网络
总线 · 交叉开关 · Mesh/Torus拓扑
互连片上网络
25
功耗管理固件
ACPI · P-state · C-state
功耗管理固件ACPI
26
热管理
热设计功耗 · 热传感器 · 动态热管理
热管理热设计功耗
27
硬件加速器集成
AI加速器 · 加密引擎 · DMA控制器
硬件加速器集成AI
28
验证与调试
仿真验证 · 形式验证 · FPGA原型验证
验证调试
29
性能与功耗权衡分析
帕累托最优 · 设计空间探索 · 功耗性能比
性能功耗权衡分析
30
综合实战项目
基于RISC-V核的SoC性能调优与…
综合实战项目RISC-V