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PCIe状态机切换时序：从L0到L1的延迟分析

共计 30 章节
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01
PCIe链路状态机概述
L0 · L0s · L1
PCIe链路状态机概述
02
L0状态详解
全速工作模式下的数据链路层与物理层行…
L0状态详解
03
L1状态详解
低功耗待机模式下的时钟与电源管理机制
L1状态详解
04
L0→L1切换触发条件
ASPM（主动电源管理）与软件触发机…
L0L1
05
L0→L1切换时序图
从TLP暂停到电气空闲的完整信号序列
L0L1
06
L1入口延迟组成
发送端缓冲排空时间 · 接收端确认时间 · 电气空闲建立时间
L1入口延迟组成
07
TxIdle与RxIdle状态
物理层进入电气空闲前的准备阶段
TxIdleRxIdle
08
TS1/TS2训练序列在L0→L1切换中的作用。
TS1/TS2训练序列在L0→L1切换中… · 核心概念 · 实践要点
TS1/TS2L0
09
L1子状态
L1.1与L1.2的区别及各自延迟特…
L1子状态
10
L1.1入口时序
时钟保持模式下的切换延迟分析
L1.1入口时序
11
L1.2入口时序
时钟关闭模式下的切换延迟分析
L1.2入口时序
12
L1→L0恢复过程
从电气空闲到重新训练的全流程
L1L0
13
L1→L0恢复延迟组成
唤醒信号传播 · 电气空闲退出 · 链路训练
L1L0
14
Beacon信号与WAKE#信号在L1唤醒中的角色。
Beacon信号与WAKE#信号在L1唤… · 核心概念 · 实践要点
BeaconWAKE#
15
L1→L0恢复时序图
Beacon/WAKE#→电气空闲退…
L1L0
16
L0s状态简介
与L1的区别及适用场景
L0s状态简介
17
L0s→L0恢复延迟
比L1恢复快的原因分析
L0sL0
18
L0→L1延迟的典型数值范围
PCIe Gen3/Gen4/Gen…
L0L1
19
影响L0→L1延迟的关键因素
链路宽度 · 速率 · 缓冲区深度
L0L1
20
ASPM策略对延迟的影响
L0s优先 vs L1优先
ASPM策略对延迟的影响
21
软件触发L1 vs ASPM自动L1的延迟差异。
软件触发L1 vs ASPM自动L1的延… · 核心概念 · 实践要点
L1vs
22
L1入口延迟的测量方法
逻辑分析仪抓取电气空闲信号
L1入口延迟的测量方…
23
L1恢复延迟的测量方法
从WAKE#到第一个有效TLP的时间
L1恢复延迟的测量方…
24
延迟优化技术
快速唤醒机制与预训练策略
延迟优化技术快速唤醒机制
25
PCIe Gen6中的L1延迟改进
L0p与更低延迟的L1入口
PCIeGen6
26
L1延迟对系统性能的影响
网络 · 存储 · GPU场景分析
L1延迟对系统性能的…
27
L1延迟与功耗的权衡
如何根据应用场景选择L1子状态
L1延迟
28
实际案例分析
某SSD在L0→L1切换中的延迟实测…
实际案例分析SSD
29
PCIe链路状态机调试工具
使用PCIe分析仪查看状态切换
PCIe链路状态机调试工…
30
课程总结
L0→L1延迟分析的关键要点与设计建…
课程总结L0