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《UVM芯片验证环境搭建与自动化回归》
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UVM芯片验证环境搭建与自动化回归
📚 共计 30 章节
01
验证环境概述
什么是验证 · 验证在芯片设计流程中的位置 · 验证工程师的职责与技能树
基础
概念
02
验证方法论
定向测试 vs 随机测试 · UVM方法论简介 · 覆盖率驱动验证(CDV)概念
方法论
UVM
03
Linux基础与工具链
Linux常用命令 · VCS/QuestaSim安装配置 · Makefile基础
工具
环境
04
SystemVerilog基础 (上)
数据类型 · 数组 · 结构体 · 枚举 · always_comb / always_ff
SV
语法
05
SystemVerilog基础 (中)
接口(interface) · 时钟块(clocking block) · 断言(SVA)入门
SV
接口
06
SystemVerilog基础 (下)
OOP基础 · 类 · 继承 · 多态 · 随机化与约束
OOP
随机化
07
验证组件之Driver
Driver的作用与设计 · 事务级到信号级转换 · 时序控制与驱动
Driver
UVM
08
验证组件之Monitor
Monitor的作用与设计 · 信号采样与事务级打包 · 覆盖率收集
Monitor
采样
09
验证组件之Sequencer
Sequencer的作用 · Sequence与Sequencer交互 · 启动与仲裁
Sequencer
Sequence
10
验证组件之Agent
Agent封装 · Active与Passive模式 · config_db的使用
Agent
配置
11
验证组件之Env
Env构建与连接 · Sub_env层次化 · 顶层Env搭建
Env
层次化
12
验证组件之Test
Test启动流程 · Test配置 · Test与Env交互
Test
启动
13
验证组件之Scoreboard
Scoreboard作用 · 参考模型设计 · 数据比较与错误报告
Scoreboard
比对
14
验证组件之Coverage
覆盖率类型 · covergroup/coverpoint · 交叉覆盖率
覆盖率
功能覆盖
15
UVM核心机制之Factory
Factory模式 · type_override · instance_override
Factory
重载
16
UVM核心机制之Phase
UVM Phase机制 · build/connect/run/report_phase
Phase
生命周期
17
UVM核心机制之TLM
事务级建模(TLM) · put/get/transport · analysis端口与fifo
TLM
事务
18
UVM核心机制之Sequence
Sequence进阶 · 嵌套Sequence · 同步与资源
Sequence
进阶
19
UVM核心机制之Config
配置数据库(config_db)详解 · set/get · 层次化配置
config_db
配置
20
UVM核心机制之Report
报告机制 · 消息ID与严重性 · report_handler定制
报告
handler
21
验证计划与测试用例
编写验证计划 · 测试用例分类与优先级 · 回归测试
计划
回归
22
断言(SVA)实战
立即断言与并发断言 · 断言嵌入环境 · 断言覆盖率
SVA
断言
23
寄存器模型(RAL)
RAL概念 · UVM RAL构建 · 前门/后门访问 · 寄存器预测
RAL
寄存器
24
验证环境调试
波形调试技巧 · 日志分析 · 死锁与竞争排查
调试
波形
25
性能验证
吞吐量测试 · 延迟测试 · 带宽测试 · 性能瓶颈分析
性能
吞吐
26
低功耗验证
低功耗设计简介 · UPF/CPF基础 · 低功耗验证策略
低功耗
UPF
27
形式化验证入门
形式化概念 · 与动态仿真对比 · 断言证明与属性检查
形式化
属性
28
验证环境自动化
脚本化环境搭建 · 回归测试自动化 · 报告自动生成
自动化
脚本
29
项目实战:I2C验证 (上)
需求分析 · 验证计划 · 环境架构设计
I2C
实战
30
项目实战:I2C验证 (下)
组件编码 · 环境集成 · 调试与覆盖率收敛
I2C
收敛
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