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198-AMD Versal异构计算与高速系统工程
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《AMD Versal视频图像处理系统工程》
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AMD Versal视频图像处理系统工程
共计 30 章节
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01
Versal视频图像处理系统工程导论
目标=课程目标 · Versal器件家族与视频图像处理系… · 典型应用场景与开发流程总览
Versal
视频图像处理系统…
02
Versal架构与视频图像处理相关的硬核资源
目标=AI Engine · 可编程逻辑 · DSP58
Versal
架构
03
视频图像处理系统的数据流与带宽规划
目标=分辨率 · 帧率 · 像素格式
视频图像处理系统…
带宽规划
04
Vivado与Vitis统一开发环境搭建
目标=Versal器件选型 · 板级支持包 · 平台工程创建
Vivado
Vitis
05
视频输入接口工程实现
目标=MIPI CSI-2 · HDMI · SDI等接口的接收
视频输入接口工程…
MIPI
06
视频输出接口工程实现
目标=DisplayPort · HDMI · MIPI DSI等输出链路
视频输出接口工程…
DisplayPort
07
AXI4-Stream视频协议与IP互连
目标=Video In to AXI… · AXI4-Stream to Vid… · 像素打包
AXI4-Stream
IP
08
视频帧缓冲与DDR访问优化
目标=帧缓存架构 · AXI VDMA/Frame Buf… · 突发传输
DDR
视频帧缓冲
09
图像预处理流水线设计
目标=去马赛克 · 坏点校正 · 黑电平校正
图像预处理流水线…
目标=去马赛克
10
图像滤波与增强的FPGA实现
目标=高斯滤波 · 中值滤波 · Sobel边缘检测
FPGA
图像滤波
11
AI Engine架构与图像处理编程模型
目标=AI Engine阵列 · 向量处理器 · 内存层次
AI
Engine
12
AI Engine图像处理内核开发实战
目标=卷积 · 池化 · 激活函数
AI
Engine
13
AI Engine与可编程逻辑协同的视频流水线
目标=PL采集/预处理 · AI Engine加速 · PL后处理与显示的异构任务划分与接口…
AI
Engine
14
基于Versal的实时目标检测系统
目标=YOLO/SSD等模型部署 · 量化 · AI Engine映射
Versal
基于
15
视频图像处理中的NoC与内存访问优化
目标=NoC QoS配置 · AI Engine与DDR/PL间数… · 带宽瓶颈分析与延迟隐藏策略
NoC
视频图像处理
16
多路视频拼接与融合系统
目标=多路输入同步 · 几何校正 · 图像配准
多路视频拼接
融合系统
17
视频缩放与格式转换硬件设计
目标=多相滤波器 · 双线性/双三次缩放 · YUV/RGB转换
视频缩放
格式转换硬件设计
18
视频编解码与压缩处理
目标=VCU集成 · H.264/H.265编解码流水线 · 码率控制
视频编解码
压缩处理
19
图像质量评估与调试
目标=PSNR · SSIM · VMAF等指标
图像质量评估
调试
20
低延迟视频处理系统设计
目标=流水线延迟分析 · 行缓冲/帧缓冲策略 · 实时反馈控制与端到端延迟优化
低延迟视频处理系…
目标=流水线延迟…
21
高动态范围与宽色域处理
目标=HDR元数据处理 · 色调映射 · 广色域转换与Versal中的定点/浮…
高动态范围
宽色域处理
22
多传感器融合与智能视觉
目标=可见光/红外/深度相机同步 · 配准 · 融合与AI Engine上的多模态处…
多传感器融合
智能视觉
23
Versal视频处理系统的功耗与热管理
目标=动态功耗估算 · 时钟门控 · 电压频率调节
Versal
视频处理系统的功…
24
系统级仿真与验证
目标=Vivado仿真 · Vitis HLS C/RTL协同仿… · AI Engine仿真
系统级仿真
验证
25
Linux与嵌入式软件集成
目标=PetaLinux构建 · 设备树 · DMA驱动
Linux
嵌入式软件集成
26
基于Vitis的异构加速流程
目标=平台创建 · 内核编译 · 链接
Vitis
基于
27
视频图像处理IP封装与复用
目标=AXI4-Stream IP打… · Vitis HLS导出 · IP Integrator集成与版本…
IP
视频图像处理
28
实际工程案例
目标=智能交通视频分析系统 · 车牌识别 · 目标跟踪
实际工程案例
目标=智能交通视…
29
实际工程案例
目标=医疗内窥镜图像处理系统 · 增强 · AI辅助检测与Versal异构平台部…
实际工程案例
目标=医疗内窥镜…
30
课程总结与工程最佳实践
目标=设计模式 · 性能瓶颈排查 · 资源优化
课程总结
工程最佳实践
所属VIP或分类
同VIP:AMD-Versal-AI-Engine信号处理工程
同VIP:AMD-Versal-DDR存储接口工程
同VIP:AMD-Versal-PCIe高速互连系统设计与集成