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FPGA信号连接与数字逻辑设计

共计 30 章节
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01
课程导入
FPGA基本概念 · 信号连接与数字逻辑设计的整体框架 · 学习路径与工具链概述
课程导入FPGA
02
数字逻辑基础
布尔代数 · 逻辑门 · 组合逻辑与时序逻辑的核心概念及FPG…
数字逻辑基础布尔代数
03
FPGA架构与资源
可编程逻辑单元 · 查找表（LUT） · 触发器
FPGA架构
04
硬件描述语言入门
Verilog/VHDL语法基础 · 模块化设计 · 数据类型
硬件描述语言入门Verilog/VHDL
05
组合逻辑设计
多路选择器 · 译码器 · 编码器
组合逻辑设计多路选择器
06
时序逻辑设计
触发器 · 寄存器 · 锁存器
时序逻辑设计触发器
07
有限状态机（FSM）
Moore与Mealy状态机 · 状态编码 · 状态转移图
FSM有限状态机
08
信号连接基础
FPGA内部信号互联 · 布线资源 · 引脚分配（Pin Assignmen…
信号连接基础FPGA
09
时钟与复位设计
时钟树 · 全局时钟网络 · 时钟分频/倍频（PLL/MMCM）
时钟复位设计
10
同步与异步设计
跨时钟域（CDC）问题 · 亚稳态 · 同步器
同步异步设计
11
总线与接口信号连接
UART · SPI · I2C
总线接口信号连接
12
存储器接口设计
BRAM · FIFO · ROM的配置与使用
存储器接口设计BRAM
13
时序约束与静态时序分析（STA）
时序约束文件（SDC） · 时钟约束 · 输入输出延迟约束
STA时序约束
14
仿真与验证方法
Testbench编写 · 仿真波形分析 · 功能仿真
仿真验证方法
15
综合与实现流程
RTL综合 · 逻辑优化 · 映射
综合实现流程
16
信号完整性基础
反射 · 串扰 · 地弹
信号完整性基础反射
17
高速信号连接
高速串行收发器（SerDes） · GTX/GTH · PCIe
高速信号连接SerDes
18
FPGA调试技术
在线逻辑分析仪（ILA） · 虚拟I/O（VIO） · JTAG调试
FPGA调试技术
19
低功耗设计
动态功耗与静态功耗 · 时钟门控 · 电源管理
低功耗设计动态功耗
20
可重构与部分重配置
动态重配置原理 · ICAP接口 · 重配置流程及在信号连接中的应用
可重构部分重配置
21
案例实战
基于FPGA的LED流水灯与按键控制…
案例实战FPGA
22
案例实战
UART通信模块设计——包括接收 · 发送 · 波特率生成及与PC的串口连接
案例实战UART
23
案例实战
SPI/I2C接口驱动——与外部传感…
案例实战SPI/I2C
24
案例实战
数字信号处理基础——FIR滤波器 · FFT的FPGA实现及信号连接
案例实战FIR
25
案例实战
状态机应用——交通灯控制器 · 序列检测器及复杂状态机的设计优化
案例实战状态机应用
26
常见问题与误区
信号连接中的毛刺 · 竞争冒险 · 时序违规
常见问题误区
27
设计优化与重构
面积优化 · 速度优化 · 流水线设计
设计优化重构
28
FPGA开发板实战
基于Xilinx/Altera开发板… · 模块划分 · 信号连接到板级调试
FPGA开发板实战
29
综合提升
FPGA与SoC协同设计 · 软核处理器（MicroBlaze/N…
综合提升FPGA
30
课程总结与进阶方向
回顾核心知识点 · 常见面试题解析 · FPGA学习资源推荐及未来发展趋势（…
课程总结进阶方向