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《ASIC设计静态时序分析PrimeTime从理论到签核》
所属分类:芯片半导体与FPGA
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ASIC设计静态时序分析PrimeTime从理论到签核
共计 30 章节
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01
课程导入
学习目标 · 课程大纲 · STA在ASIC设计流程中的角色与重…
课程导入
学习目标
02
时序分析基础
时钟 · 触发器 · 组合逻辑
时序分析基础
时钟
03
STA与动态仿真的区别
为什么需要静态时序分析 · STA的优势与局限性
STA
动态仿真的区别
04
PrimeTime工具入门
PrimeTime的启动 · 界面 · 主要命令
PrimeTime
工具入门
05
时序库基础
Liberty库格式 · 单元时序模型 · 延迟计算
时序库基础
Liberty
06
约束文件SDC
时钟定义 · 时钟不确定性 · 输入输出延迟
SDC
约束文件
07
时钟约束详解
时钟源 · 时钟树 · 生成时钟
时钟约束详解
时钟源
08
输入输出约束
输入延迟 · 输出延迟 · 外部驱动
输入输出约束
输入延迟
09
时序路径分析
建立时间路径 · 保持时间路径 · 时钟门控路径
时序路径分析
建立时间路径
10
PrimeTime报告解读
时序报告 · 违例报告 · 路径报告
PrimeTime
报告解读
11
时序违例修复策略
优化组合逻辑 · 插入缓冲器 · 调整约束
时序违例修复策略
优化组合逻辑
12
时钟树综合与STA
时钟树综合后的时序分析 · 时钟偏斜 · 时钟延迟对时序的影响
STA
时钟树综合
13
片上变化(OCV)
OCV概念 · derating · AOCV
OCV
片上变化
14
多模式多角分析(MMMC)
不同工艺角 · 电压 · 温度下的时序分析
MMMC
多模式多角分析
15
时序收敛流程
从综合到布局布线 · 时序收敛的迭代流程 · ECO流程
时序收敛流程
从综合到布局布线
16
PrimeTime高级命令
脚本化操作 · 批量处理 · 时序分析自动化
PrimeTime
高级命令
17
时序例外约束
多周期路径 · 伪路径 · 最小延迟
时序例外约束
多周期路径
18
异步时序处理
异步FIFO · 同步器 · 亚稳态
异步时序处理
FIFO
19
功耗与时序权衡
低功耗设计中的时序考虑 · 电压降 · 功耗感知的时序分析
功耗
时序权衡
20
签核级STA
签核标准 · 时序签核流程 · PrimeTime签核模式
STA
签核级
21
案例实战
一个简单ASIC设计的完整STA流程 · 从约束到签核
案例实战
ASIC
22
案例实战
时钟树综合后的时序分析与修复
案例实战
时钟树综合后的时…
23
案例实战
多时钟域设计的时序约束与分析
案例实战
多时钟域设计的时…
24
案例实战
OCV与AOCV在PrimeTime…
案例实战
OCV
25
案例实战
MMMC分析在PrimeTime中的…
案例实战
MMMC
26
常见问题与调试技巧
时序违例常见原因 · 调试方法 · 常见错误
常见问题
调试技巧
27
PrimeTime与其他工具集成
与综合工具 · 布局布线工具 · 形式验证工具的交互
PrimeTime
其他工具集成
28
STA脚本编程
Tcl脚本在PrimeTime中的应… · 自动化分析流程
STA
脚本编程
29
综合提升
STA在先进工艺节点(FinFET · 纳米级)中的挑战与应对
综合提升
STA
30
课程总结与展望
STA发展趋势 · 学习资源 · 职业发展建议
课程总结
STA
所属VIP或分类
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