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《高速SerDes_CTLE低电压鲁棒设计实战》
所属分类:硬件射频与高速接口
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高速SerDes_CTLE低电压鲁棒设计实战
共计 30 章节
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01
课程导入
高速SerDes系统概述 · CTLE在接收端的作用 · 低电压与鲁棒性设计挑战
课程导入
SerDes
02
SerDes基础与信道特性
SerDes架构 · PAM4与NRZ调制 · 信道损耗
SerDes
信道特性
03
CTLE原理与频响特性
CTLE的传递函数 · 直流增益 · 峰值增益
CTLE
原理
04
低电压设计挑战
电源电压降低对CTLE线性度 · 增益 · 带宽
低电压设计挑战
CTLE
05
CTLE电路拓扑
无源RC/RL · 有源差分对 · 源极退化
CTLE
电路拓扑
06
CTLE参数设计方法
根据信道损耗曲线确定峰值频率 · 增益 · 带宽
CTLE
参数设计方法
07
低电压CTLE电路设计
在0.9V/0.8V等低电源下选择晶… · 偏置点 · 摆幅限制
CTLE
低电压
08
鲁棒性设计基础
PVT变化 · 工艺角 · 温度
鲁棒性设计基础
PVT
09
自适应均衡与CTLE控制
LMS算法 · 眼图监视器 · 自适应增益调节
CTLE
自适应均衡
10
CTLE与DFE/FFE协同设计
均衡器组合策略 · CTLE与DFE的带宽分配 · 低电压下的协同优化
CTLE
DFE/FFE
11
噪声与线性度分析
CTLE的输入参考噪声 · 谐波失真 · IM3
噪声
线性度分析
12
带宽扩展技术
电感峰化 · T-coil · 有源反馈
带宽扩展技术
电感峰化
13
低电压偏置电路设计
电流镜 · 带隙基准 · 共模反馈
低电压偏置电路设…
电流镜
14
ESD与输入保护设计
低电压CTLE的ESD结构 · 寄生电容影响 · 与输入匹配的协同设计
ESD
输入保护设计
15
版图设计要点
差分对称 · 寄生提取 · 电源地去耦
版图设计要点
差分对称
16
仿真方法
AC · 瞬态 · 眼图
仿真方法
AC
17
建模与行为级仿真
Verilog-A/AMS建模CTL… · 系统级仿真 · 与SPICE的联合验证
建模
行为级仿真
18
测试与测量
眼图仪 · 误码率测试 · S参数测量
测试
测量
19
案例实战
基于28nm/16nm工艺的0.9V… · 从规格到版图的全流程
案例实战
nm/16nm
20
案例实战
针对长信道(如30dB损耗)的CTL… · 低电压下如何达到目标眼高眼宽
案例实战
dB
21
案例实战
自适应CTLE设计 · 在低电压下实现快速收敛与鲁棒性
案例实战
CTLE
22
常见问题
低电压下CTLE增益不足 · 如何通过拓扑与偏置优化解决
常见问题
CTLE
23
常见问题
CTLE带宽不足导致眼图闭合 · 如何利用电感峰化或T-coil扩展
常见问题
CTLE
24
常见问题
PVT变化导致均衡失效 · 如何设计鲁棒的自适应或校准电路
常见问题
PVT
25
常见问题
电源噪声耦合影响CTLE性能 · 如何通过电源滤波与隔离改善
常见问题
CTLE
26
常见问题
CTLE与DFE接口不匹配 · 如何调整阻抗与带宽
常见问题
CTLE
27
综合提升
低电压CTLE的功耗-性能-面积权衡 · 以及先进工艺下的设计趋势
综合提升
CTLE
28
综合提升
面向PCIe/USB/以太网等标准的…
综合提升
PCIe/USB
29
综合提升
CTLE设计中的创新技术 · 如数字辅助校准 · 机器学习优化
综合提升
CTLE
30
课程总结与项目实战
综合设计一个低电压鲁棒CTLE · 完成仿真 · 版图
课程总结
项目实战
所属VIP或分类
同VIP:ADC采样与信号调理全流程实战
同VIP:ADS信号完整性仿真-高速电路PCB-SI
同VIP:Ansys-HFSS高速串行链路SerDes信号完整性仿真