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PCIe链路训练状态机：Gen1到Gen5速率协商流程

共计 30 章节

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PCIe总线架构 · 拓扑结构 · 分层协议栈（事务层

PCIe总线架构

链路训练状态机（LTSSM）简介

LTSSM的作用 · 状态机基本概念 · 11个主要状态概览

LTSSM链路训练状态机

Detect状态（检测）

Detect.Quiet子状态 · Detect.Active子状态 · 接收器检测逻辑与电气空闲退出

Polling状态（轮询）

Polling.Active子状态 · Polling.Compliance… · 发送TS1/TS2训练序列

Configuration状态（配置）

Configuration.Link… · Configuration.Lane… · Configuration.Comp…

Configuratio…状态

L0状态（正常操作）

L0状态下的数据包传输 · SKP有序集插入 · 电气空闲退出机制

L0s状态（节能轻睡眠）

L0s.Entry · L0s.Exit流程 · 快速唤醒机制

L1状态（节能深睡眠）

L1.Entry条件 · L1.Exit流程 · L1 Substates（L1.1

L2状态（辅助电源睡眠）

L2.Idle · L2.Transmit.Wake · L2.Wakeup流程

Recovery状态（恢复）

Recovery.RcvrLock · Recovery.RcvrCfg · Recovery.Idle

Hot Reset状态（热复位）

Hot Reset.Entry · Hot Reset.Exit · 与Cold Reset的区别

Disabled状态（禁用）

Disabled.Entry条件 · Disabled.Exit · 链路禁用后的行为

Loopback状态（回环）

Loopback.Entry · Loopback.Active · Loopback.Exit

Gen1速率协商基础

5GT/s数据速率 · 8b/10b编码 · 训练序列TS1/TS2结构详解

Gen1速率协商基础

Gen2速率协商

0GT/s数据速率 · 8b/10b编码 · 去加重（De-emphasis）技术

Gen2速率协商

Gen3速率协商

0GT/s数据速率 · 128b/130b编码 · 均衡（Equalization）技术

Gen3速率协商

Gen4速率协商

0GT/s数据速率 · 128b/130b编码 · 增强均衡

Gen4速率协商

Gen5速率协商

0GT/s数据速率 · 128b/130b编码 · PAM4调制（可选）

Gen5速率协商

速率协商流程

从Gen1开始 · 逐步升速 · Recovery.Equalizat…

速率协商流程Gen1

链路宽度协商

x1/x2/x4/x8/x16/x3… · Configuration状态中的宽… · 降宽机制

链路宽度协商x1/x2/x4/x8/…

均衡（Equalization）详解

发送端均衡（TxEQ） · 接收端均衡（RxEQ） · 系数协商过程

Equalization均衡

训练序列（TS1/TS2）详解

TS1/TS2有序集格式 · 符号位定义 · 速率标识

TS1/TS2训练序列

电气空闲与信令

电气空闲（Electrical Id… · 退出电气空闲（Exit Electr… · 信令条件

电气空闲信令

链路状态转换图

完整LTSSM状态转换图 · 各状态之间的合法转换路径 · 异常处理路径

链路状态转换图LTSSM

链路训练超时与重试

各种超时定时器（例如 · Polling Timeout） · 重试机制

链路训练超时重试

链路训练错误处理

CRC错误 · 训练失败 · 降速/降宽回退

链路训练错误处理CRC

PCIe Gen1-Gen5兼容性

向下兼容机制 · Gen1/Gen2/Gen3/Gen…

链路训练调试方法

逻辑分析仪抓取训练序列 · LTSSM状态寄存器读取 · PCIe分析仪使用

链路训练调试方法逻辑分析仪抓取训…

0GT/s数据速率 · PAM4调制 · FEC增强

课程总结与实战

LTSSM状态机核心要点回顾 · 常见面试题 · 实际项目中的链路训练问题排查思路

课程总结LTSSM