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第4章：电磁场理论与PCB中的寄生参数

做PCB设计，做到一定年头你就会发现，电路图上的理想元件在板子上全变了个样。电阻不只是电阻，它还带着电感和电容。走线也不只是一根铜皮，它既是天线又是传输线。这背后的根源，就是电磁场和寄生参数。

我当年刚入行时，画了一块小板的DC-DC，仿真怎么跑都OK。结果一做EMI测试，150kHz到30MHz，超标整整15dB。折腾了大半个月，最后发现就是输出滤波电容的寄生电感太大，跟PCB走线形成了一个谐振腔。从那以后，我再也不敢小瞧这些“看不见的元件”了。

电场耦合与磁场耦合

先说说两种最基本的耦合方式。你想想看，两根靠得很近的走线，它们之间会发生什么？

电场耦合，说白了就是寄生电容的效应。一根线上有电压变化，会通过它们之间的分布电容，在另一根线上感应出电荷。这就像两个平行板电容器一样，距离越近、重叠面积越大、介质介电常数越高，耦合就越强。

磁场耦合呢，则是互感效应。一条线上流过变化的电流，会在周围产生变化的磁场，这个磁场扫过另一条线时，就会感应出电压。我在项目中遇到过好几次，一条时钟线跟一条复位线挨着走，结果复位信号上总是出现时钟的毛刺，就是磁场耦合惹的祸。

耦合类型	激励源	耦合路径	抑制方法
电场耦合	电压变化 (dV/dt)	寄生电容	增大间距、加GND隔离、降低源端阻抗
磁场耦合	电流变化 (dI/dt)	寄生电感/互感	减小回路面积、使用差分信号、增加间距

注意：不要光盯着一种耦合。很多时候，高频信号在城市里是电场和磁场同时存在，耦合方式也不止一种。我建议你先搞清楚源头是什么——是电压跳变还是电流跳变，再对症下药。

寄生电容：你画出来的每一根走线都是电容

PCB上处处都是寄生电容。走线与参考平面之间有电容，相邻走线之间有电容，焊盘对面也有电容。在低频时，这些电容的影响微乎其微。可一旦频率高起来，比如一个100MHz的时钟信号，它们就会变成实实在在的噪声通路。

寄生电容的估算其实很简单：

C = ε × (A / d)

其中：
ε = ε₀ × εr（介电常数）
A = 走线对参考平面的投影面积
d = 走线到参考平面的距离（介质厚度）

举个例子，一条长10mm、宽0.25mm的走线，如果它在表层，到第二层的距离是0.2mm，FR4的εr大约是4.5。那么它跟参考平面之间的寄生电容大约是：

C = 8.85e-12 × 4.5 × (10e-3 × 0.25e-3) / 0.2e-3
  ≈ 0.5 pF

0.5pF看起来不大对吧？可在100MHz时，它的阻抗大概是3.2kΩ。如果这个电容刚好耦合到敏感电路上，足以让信号严重失真。我曾遇到过一块DDR3的内存条，因为数据线层的铺铜太近，导致DQ信号和DQS信号的寄生电容不对称，读写时序直接跑飞了。

个人习惯：在布局阶段，我会把高速信号线跟敏感信号线之间留出至少3倍线宽的间距。翻车太多的人才会明白，这3倍间距的性价比实在太高了。

寄生电感：电流的惯性

电感这东西，说白了就是电流的“惯性”。电流想突然变化？门儿都没有，电感会拉着它慢慢来。在PCB上，走线、过孔、封装引线，甚至电容本身，全都自带寄生电感。

一个典型的走线寄生电感可以用下式估算：

L ≈ 0.2 × l × [ln(2 × l / w) + 0.5] (nH)

其中：
l = 走线长度（mm）
w = 走线宽度（mm）

一根长10mm、宽0.25mm的走线，寄生电感大约在7~10nH左右。如果这条线上流过的是1A、上升沿为1ns的电流，你算算它会在走线两端感应出多大的电压尖峰？

V = L × di/dt
V ≈ 10e-9 × (1A / 1e-9s) = 10V

看到没？一根短短的走线，就能造成10V的压降尖峰。这就是为什么在高速设计中，电源完整性和地弹现象如此突出的原因。

关键认知：寄生电感不是坏东西，关键是要把它管好。在电源路径上，我们要尽量降低电感，减少电压波动。在需要抑制高频噪声的地方，比如共模扼流圈本身，就是利用电感来阻挡高频电流。

地弹与回流路径

这里我要重点说一下地弹。很多人以为GND就是0V，打死都不会变。可实际上GND是有阻抗的，当多个高速信号同时返回GND时，会在地平面上产生瞬态压降。这个压降就等于：

V_ground_bounce = L_ground × dI/dt

地弹最直接的影响是什么？就是你的芯片内部GND电位和你的PCB GND电位不一致了。这样芯片的参考电平就乱了，该判1的判成0，该判0的判成1。我记得在给一个FPGA做设计时，DDR2出数一直有问题，用示波器一看，DQS信号上叠着一个跟时钟同步的正弦波。后来量了芯片GND到PCB GND之间的电压差……好家伙，800mV的峰峰值。

解决办法很简单：缩短回流路径，减小回路面积。每一个信号都必须紧挨着它的回流路径走。信号往前流，电流从地平面回来，中间围成的面积越小，寄生电感和对外辐射都越小。

我曾经见过：有工程师为了让布局更整齐，把DDR的数据线拉得整整齐齐，结果回流路径绕了一大圈。那款板子最后到了EMI测试阶段，辐射超标严重，整改成本比重新做一版还高。走线整齐不等于好，回流路径正确才是硬道理。

寄生参数的总账

前几节我们拆开讲了电容、电感、耦合。做设计时，真正需要的是把它们合在一起看。我给你画了一张图，希望你一次看懂：

寄生参数综合对比

寄生参数	主要来源	影响方式	设计控制核心
寄生电容	走线对地/对邻线/焊盘	高频耦合，形成串扰	控制线宽、层间距、铺铜形状
寄生电感	走线、过孔、封装引脚	产生尖峰电压、地弹、振铃	缩短走线、增加宽度、减少过孔
互感	相邻回路共享磁场	感应噪声，干扰敏感信号	正交布线、增大间距、缩短平行长度
公共阻抗	电源/地平面、回流路径重叠	各路信号互相干扰	分割回路、加宽平面、星形接地

嗯，写到这儿你会发现，所有EMI问题，本质上都是电磁场与寄生参数的博弈。你能管好它们，就掌握了90%的EMC整改能力。后面的章节里，我会带你一步步把这些原理用在具体布局和滤波上。