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UCIe物理层链路训练与均衡调试

共计 30 章节
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01
UCIe概述
UCIe标准背景 · 物理层分层架构 · 与其它互联方案的对比
UCIe标准背景
02
物理层协议栈
逻辑物理层（RTL） · 电气物理层（Analog）的分工与接…
物理层协议栈RTL
03
PIPE接口协议
PIPE 5.0/6.0信号定义 · TX/RX数据通路 · 状态机切换
PIPE接口协议
04
链路初始化流程
Reset · Polling · Config
链路初始化流程Reset
05
训练序列TS1/TS2
帧结构 · 握手过程 · 锁相与符号锁定
TS1/TS2训练序列
06
时钟数据恢复CDR
原理 · 相位插值器 · 锁相环配置与调试
CDR时钟数据恢复
07
TX均衡
FFE预加重 · 去加重 · 抽头系数设置与调试观察
TX均衡
08
RX均衡
CTLE · DFE · VGA的协同工作与自适应算法
RX均衡
09
眼图测量
示波器设置 · 眼图张开度 · 眼宽眼高指标分析
眼图测量示波器设置
10
抖动分析
RJ · DJ · Tj
抖动分析RJ
11
误码率测试
BERT设置 · PRBS发生器/检测器 · 长/短PRBS选择
误码率测试BERT
12
PRBS调试
PRBS7/9/15/31模式 · 同步与失锁判断
PRBS调试
13
调试总线SB/DBI
Sideband与Data Bus…
SB/DBI调试总线
14
调试寄存器
PHY状态寄存器 · 调试控制寄存器 · 错误计数器
调试寄存器PHY
15
JTAG调试
TAP控制器 · 边界扫描 · IR/DR寄存器操作
JTAG调试
16
ICE接口
In-Circuit Emulati… · 断点与单步调试
ICE接口
17
物理层测试模式
Loopback · Link Equalization… · Compliance Test
物理层测试模式Loopback
18
仿真验证
UVM Testbench搭建 · PHY模型 · 激励与波形分析
仿真验证UVM
19
硬件调试方法
逻辑分析仪捕获 · 示波器触发 · 事件溯源
硬件调试方法逻辑分析仪捕获
20
眼图张开度优化
通过手动调整EQ参数改善眼图
眼图张开度优化EQ
21
信号完整性SI
PCB走线阻抗 · 过孔 · 耦合导致的眼图退化
SI信号完整性
22
电源完整性PI
PDN噪声对PHY性能的影响 · 去耦电容策略
PI电源完整性
23
参考时钟抖动
晶振选择 · 时钟分配 · SSC调制与链路锁定
参考时钟抖动晶振选择
24
PCB走线设计
差分对等长 · Stub最小化 · 层叠设计要点
PCB走线设计
25
调试工具使用
高端示波器 · 误码仪 · 逻辑分析仪
调试工具使用高端示波器
26
实战案例一
链路无法进入L0状态——排查Rese…
实战案例一L0
27
实战案例二
眼图闭合——通过EZ-Tune自动均…
实战案例二EZ-Tune
28
实战案例三
间歇性误码——SSC调制与CDR跟踪…
实战案例三SSC
29
常见问题排错
CRC错误 · Phy Status冲突 · 电压温度漂移
常见问题排错CRC
30
进阶与未来
UCIe 2.0/3.0新特性 · CXL集成调试 · 生态工具展望
进阶未来