1、信号链路概述：什么是模拟信号链、数据采集系统的基本架构、关键性能指标（SNR、THD、SFDR、ENOB）
各位同学，欢迎来到《数据采集系统模拟信号链路设计实战》的第一讲。
做硬件设计这么多年，我见过太多工程师一上来就盯着ADC选型，结果板子调出来性能惨不忍睹。为什么？说白了，就是没搞懂信号链路这回事。今天咱们就把地基打牢。
1.1 什么是模拟信号链？
模拟信号链，听起来高大上，其实没那么玄乎。
你想想看，我们生活的世界是连续的——温度、压力、声音，这些都是模拟量。但我们的处理器只认0和1。中间这座桥，就是模拟信号链。
我个人习惯把信号链比作一条流水线：
- 传感器：把物理量变成电信号（比如热电偶输出几毫伏）
- 调理电路：放大、滤波、电平移位（把信号"伺候"舒服了）
- ADC：把模拟量变成数字量（最后一关）
嗯，这里要注意：信号链的每一环都会引入误差。我在项目中遇到过，有人用了高精度ADC，但前端运放选了个噪声大的，结果整条链路的性能被运放拖垮了。这就是典型的"木桶效应"。
核心观点：模拟信号链的性能，取决于最弱的那一环。不是ADC精度高就万事大吉。
1.2 数据采集系统的基本架构
一个典型的数据采集系统，长什么样？我画个框图给你看：
传感器 → 信号调理（放大/衰减/滤波） → 采样保持 → ADC → 数字处理 → 存储/传输这里面有几个关键节点：
- 传感器接口：阻抗匹配、偏置电压、共模抑制。我曾经在工业现场吃过亏，传感器线长了，共模干扰直接把ADC输入端给"顶"饱和了。
- 抗混叠滤波器：这个很多人忽略。ADC采样前必须滤掉高于奈奎斯特频率的信号，否则混叠进来，神仙也救不了。
- 驱动电路：ADC的输入需要稳定的电压源来驱动。你想想看，如果前级输出阻抗太大，ADC采样瞬间的电荷注入会拉垮电压，精度全没了。
我的经验：设计时先画信号链框图，标出每一级的增益、带宽、噪声预算。别急着画原理图，先算清楚账。
1.3 关键性能指标
好了，到了硬核部分。这些指标是衡量信号链好坏的"尺子"。我建议你背下来，面试、调板子都用得上。
1.3.1 SNR（信噪比）
SNR = 信号功率 / 噪声功率，单位dB。
公式很简单：SNR (dB) = 20 * log10(V_signal / V_noise)
对于理想ADC，SNR有个理论公式：SNR = 6.02 * N + 1.76 dB，N是位数。
举个例子：16位ADC的理论SNR是6.02*16 + 1.76 ≈ 98.08 dB。但实际能到95 dB就算不错了。为什么？因为热噪声、时钟抖动、电源纹波都在拖后腿。
避坑指南：我曾经在项目里发现SNR比理论值低了3 dB，查了两天才找到原因——ADC的参考电压纹波太大。记住，参考电压的噪声会直接耦合到输出。
1.3.2 THD（总谐波失真）
THD衡量的是信号经过系统后，产生了多少谐波分量。
公式：THD = 20 * log10(√(V2² + V3² + ... + Vn²) / V1)
V1是基波，V2、V3是二次、三次谐波。
你想想看，如果输入一个纯净的正弦波，输出却多了很多"毛刺"谐波，说明系统的线性度不好。运放的压摆率不够、ADC的差分非线性（DNL）过大，都会导致THD恶化。
1.3.3 SFDR（无杂散动态范围）
这个指标很有意思。它看的是：在频谱上，信号功率和最大杂散分量（不是谐波，是杂散）的比值。
单位也是dB。SFDR越高，说明系统能分辨小信号的能力越强。
我记得有一次做多通道采集，通道间串扰导致SFDR掉了20 dB。最后发现是PCB布局时，模拟地和数字地没分开。嗯，教训深刻。
| 指标 | 关注点 | 典型值（16位ADC） |
|---|---|---|
| SNR | 噪声水平 | 85~95 dB |
| THD | 线性度 | -90 ~ -100 dB |
| SFDR | 杂散抑制 | 90~105 dB |
1.3.4 ENOB（有效位数）
ENOB是最实在的指标。它告诉你：你的ADC实际表现相当于多少位的理想ADC。
公式：ENOB = (SINAD - 1.76) / 6.02
SINAD是信号与噪声+失真之比。说白了，ENOB把噪声和谐波失真都算进去了。
举个例子：你买了个16位ADC，但实际ENOB只有12位。别惊讶，很正常。因为前端电路、时钟、电源都会"偷走"你的位数。
实战建议：选型时别只看分辨率，要看ENOB。我一般会留2~3位的余量。比如系统需要12位精度，我会选16位ENOB的ADC。
小结
这一章我们聊了：
- 模拟信号链是连接物理世界和数字世界的桥梁
- 数据采集系统的基本架构：传感器→调理→采样→ADC→处理
- 四个关键指标：SNR、THD、SFDR、ENOB
下一章，咱们深入讲讲运放选型和信号调理电路。到时候我会分享一些"翻车"案例，保证让你少走弯路。
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