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ASIC设计逻辑综合Design Compiler实战入门到精通

共计 30 章节

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ASIC设计流程概述 · 逻辑综合在流程中的位置 · Design Compiler工具简…

课程导入ASIC

逻辑综合基础

逻辑综合的定义 · 综合的三个阶段（转换 · 优化

逻辑综合基础逻辑综合的定义

Design Compiler环境搭建

Linux环境准备 · DC安装与许可配置 · 启动DC的多种方式（dc_shell

RTL设计与综合库准备

可综合RTL代码风格 · 标准单元库（.db/.lib）的组成 · 目标库/链接库/符号库的设置

DC基本操作与命令

dc_shell常用命令（read_… · link · compile

时序约束入门

时钟定义（create_clock） · 时钟不确定性（set_clock_u… · 输入/输出延迟（set_input_…

时序约束入门create

环境约束与设计规则

驱动强度（set_driving_c… · 负载电容（set_load） · 扇出限制

环境约束设计规则

综合策略与优化选项

面积与速度的权衡 · compile命令的选项（-map_… · -area_effort）

综合策略优化选项

时序分析与报告解读

DC中的时序路径 · 建立时间与保持时间检查 · report_timing命令详解

时序分析报告解读

面积与功耗报告

report_area命令 · 面积组成（组合逻辑/时序逻辑/布线） · 功耗估算（report_power）

面积功耗报告

综合约束优化实战

通过实际RTL代码（如计数器 · FIFO · ALU）进行约束设置

综合约束优化实战RTL

多时钟与异步时钟处理

多时钟域设计约束 · 生成时钟（create_genera… · 时钟分组（set_clock_gro…

多时钟异步时钟处理

输入输出接口约束实战

芯片级IO约束方法 · 输入/输出延迟的计算与设置 · 接口时序收敛技巧

输入输出接口约束…IO

层次化综合与TOP集成

层次化设计流程 · 子模块综合与约束传递 · TOP级综合的链接与编译

TOP层次化综合

DFT（可测试性设计）综合

扫描链插入流程 · DFT约束（set_dft_sign… · scan chain的编译与验证

DFT可测试性设计

低功耗综合技术

时钟门控（clock gating）… · 操作数隔离（operand isol… · 多电压域设计支持

低功耗综合技术clock

综合中的时序优化技巧

关键路径的识别与优化 · 逻辑重组（restructuring… · 路径分组（group_path）

综合时序优化技巧

面积优化与代码风格

面积优化的常用方法（资源共享 · 逻辑简化） · RTL代码风格对面积的影响

面积优化代码风格

DC脚本化与自动化

Tcl脚本基础 · DC中Tcl的扩展 · 自动化综合流程脚本编写

综合结果验证与形式验证

综合后网表的功能验证 · 形式验证（Formality）流程 · LEC（逻辑等效性检查）的常见问题

综合结果验证形式验证

SDC约束文件管理

SDC语法与常用命令 · 约束文件的组织与维护 · 多模式约束（function/tes…

SDC约束文件管理

综合中的时序例外

false_path · multi_cycle_path · min/max delay

综合时序例外

DC与后端流程衔接

输出文件（网表 · SDC · SDF）的生成

DC后端流程衔接

综合库的定制与建模

标准单元库的.lib文件解析 · 时序模型（NLDM/CCS） · 库的检查与验证

综合库的定制建模

综合中的常见问题与调试

综合错误与警告的解读 · 时序违例的调试方法 · 面积爆炸的原因分析

综合常见问题

高级综合技术

物理感知综合（physical-aw… · 综合与布局的协同优化 · 多目标优化（时序/面积/功耗）

高级综合技术physical-aw

综合项目实战（一）

以一个简单SoC模块（如UART或S… · 完成从RTL到综合网表的完整流程 · 包括约束

综合项目实战SoC

综合项目实战（二）

以一个复杂IP（如DMA控制器或加密… · 进行层次化综合 · 多时钟约束

综合项目实战IP

综合流程的自动化与集成

构建可重用的综合环境 · Makefile/脚本自动化 · CI/CD集成

综合流程的自动化集成

课程总结与进阶路径

回顾核心知识点 · 常见误区与最佳实践 · Design Compiler与新一…

课程总结进阶路径