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012-RISC-V处理器与系统开发实战
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《RISC-V SiFive核设计实战100例》
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本课程属于:012-RISC-V处理器与系统开发实战
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《RISC-V SiFive核设计实战100例》
共 100 例
01
搭建RISC-V开发环境
02
理解RISC-V指令格式
03
实现基础ALU
04
寄存器文件设计
05
程序计数器与取指
06
单周期数据通路
07
单周期控制单元
08
执行RISC-V基础指令
09
实现I型指令
10
实现U型指令
11
实现J型指令
12
实现B型分支指令
13
实现S型存储指令
14
实现L型加载指令
15
单周期处理器集成测试
16
流水线原理分析
17
流水线寄存器设计
18
流水线控制信号传递
19
数据冒险检测与转发
20
加载使用冒险处理
21
控制冒险处理
22
分支预测器设计
23
流水线处理器集成
24
实现M扩展乘除指令
25
实现移位指令优化
26
实现比较指令
27
实现系统指令
28
CSR寄存器访问
29
异常处理机制
30
中断处理机制
31
特权模式切换
32
实现定时器中断
33
实现UART输出
34
实现UART输入
35
实现GPIO控制
36
实现内存映射I/O
37
实现总线接口
38
实现指令缓存
39
实现数据缓存
40
缓存一致性基础
41
实现TLB
42
实现虚拟内存
43
实现内存保护
44
实现乘累加单元
45
实现除法器优化
46
实现流水线乘法器
47
实现浮点加法
48
实现浮点乘法
49
实现浮点除法
50
实现F扩展指令
51
实现D扩展指令
52
实现压缩指令扩展
53
实现原子指令
54
实现位操作扩展
55
实现向量扩展基础
56
实现向量加载存储
57
实现向量算术运算
58
实现向量定点运算
59
实现向量浮点运算
60
实现向量归约运算
61
实现向量掩码操作
62
实现向量长度设置
63
实现多周期处理器
64
实现微程序控制
65
实现超标量前端
66
实现乱序执行
67
实现寄存器重命名
68
实现分支目标缓冲
69
实现返回地址栈
70
实现推测执行
71
实现多核互联
72
实现缓存一致性协议
73
实现中断控制器
74
实现调试模块
75
实现性能计数器
76
实现电源管理
77
实现安全扩展
78
实现可配置处理器
79
实现流水线可视化
80
实现指令跟踪
81
实现性能分析
82
实现启动代码
83
实现链接脚本
84
实现裸机程序
85
实现中断服务程序
86
实现简易操作系统
87
实现内存管理单元
88
实现用户态与内核态切换
89
实现系统调用
90
实现多任务调度
91
实现信号量
92
实现消息队列
93
实现设备驱动框架
94
实现文件系统
95
实现网络协议栈
96
实现加密加速器
97
实现随机数生成器
98
实现温度传感器接口
99
实现FPGA原型验证
100
实现SoC集成
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