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FPGA验证与ISP时序约束实战

共计 30 章节
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01
FPGA验证概述
FPGA验证在芯片设计流程中的位置 · FPGA验证与软件仿真验证的区别 · FPGA验证的挑战与趋势
FPGA验证概述
02
验证平台搭建
硬件平台选型（Xilinx/Alte… · 开发板资源评估 · 电源与时钟树设计要点
验证平台搭建Xilinx/Alte
03
Vivado/Vitis开发环境
Vivado工程创建与管理 · IP Integrator使用 · Vitis软件平台搭建
Vivado/Vitis开发环境
04
RTL设计与仿真
Verilog/VHDL基础回顾 · 行为级仿真与门级仿真 · Testbench编写技巧
RTL设计
05
综合与实现
综合策略（Performance/A… · 物理约束（Pblock/Floorp… · 实现步骤（Place & Route…
综合实现
06
时序约束基础
时序分析基本概念（Setup/Hol… · SDC约束文件语法 · 主时钟与生成时钟约束
时序约束基础Setup/Hol
07
静态时序分析（STA）
STA原理与流程 · Path Types（Reg2Reg… · 时序路径分组
STA静态时序分析
08
时钟约束实战
时钟源特性分析 · PLL/MMCM配置与约束 · 异步时钟域处理
时钟约束实战时钟源特性分析
09
I/O约束实战
输入延迟计算（系统同步/源同步） · 输出延迟计算 · I/O标准与驱动强度选择
I/O约束实战
10
时序收敛技巧
关键路径分析 · 流水线插入 · 寄存器复制
时序收敛技巧关键路径分析
11
ISP（图像信号处理）基础
ISP Pipeline概述（Bay… · 色彩空间转换 · 自动曝光与自动白平衡
ISP图像信号处理
12
ISP算法硬件实现
卷积运算的硬件加速 · 直方图均衡化 · 双边滤波
ISP算法硬件实现
13
视频接口协议
MIPI CSI-2协议解析 · DVP并行接口时序 · HDMI/DVI接口
视频接口协议MIPI
14
图像传感器驱动
Sensor寄存器配置（I2C/SP… · 帧同步信号生成 · 行有效与场有效信号
图像传感器驱动Sensor
15
ISP验证策略
参考模型（Golden Model）… · PSNR/SSIM评估指标 · 图像数据比对方法
ISP验证策略
16
DDR控制器验证
DDR协议基础（SDRAM/DDR3… · 控制器IP配置 · 读写时序验证
DDR控制器验证
17
AXI总线验证
AXI4/AXI4-Lite/AXI… · 握手时序 · Outstanding传输
AXI总线验证
18
跨时钟域（CDC）验证
CDC问题分类（亚稳态/数据丢失/控… · 同步器设计（双级FF/握手/异步FI… · CDC验证工具
CDC跨时钟域
19
复位与电源管理验证
异步复位同步释放 · 复位树设计 · 电源域划分
复位电源管理验证
20
覆盖率驱动验证
代码覆盖率（Line/Toggle/… · 功能覆盖率定义 · 断言（SVA）编写
覆盖率驱动验证Line/Toggle
21
UVM验证方法学
UVM基础架构（Test/Env/A… · Sequence机制 · Factory模式
UVM验证方法学
22
脚本化验证流程
Tcl脚本自动化（Vivado Tc… · Python脚本用于仿真控制 · Makefile管理
脚本化验证流程Tcl
23
硬件加速验证
FPGA原型验证平台 · Emulation与Simulati… · 硬件加速器（HAPS/ProFPGA…
硬件加速验证FPGA
24
功耗分析与优化
动态功耗与静态功耗 · 功耗估算（Vivado Power… · 时钟门控优化
功耗分析优化
25
比特流生成与配置
比特流生成选项（Encryption… · 配置模式（Master/Slave/… · 多比特流管理
比特流生成配置
26
板级调试技巧
ILA（集成逻辑分析仪）使用 · VIO（虚拟输入输出）调试 · JTAG链调试
板级调试技巧ILA
27
ISP系统级验证
Sensor+ISP+DDR+Dis… · 帧率与延迟测量 · 图像质量主观评估
ISP系统级验证
28
时序约束调试
时序违例定位方法 · Clock Pessimism Re… · On-Chip Variation分…
时序约束调试时序违例定位方法
29
项目实战案例1
MIPI摄像头图像采集与显示系统（含…
项目实战案例1MIPI
30
项目实战案例2
多摄像头ISP处理系统（含DDR缓存…
项目实战案例2ISP