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PCIe协议调试与链路训练复现

共计 30 章节
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01
PCIe概述
PCIe发展史 · 性能优势 · 典型应用场景（服务器
PCIe发展史
02
PCIe体系结构
层次化设计——事务层 · 数据链路层 · 物理层
PCIe体系结构
03
PCIe配置空间
配置空间布局（前256字节） · Capability结构 · BAR空间
PCIe配置空间
04
PCIe事务层（TLP）
TLP格式 · 主要类型（MRd · MWr
PCIeTLP
05
PCIe数据链路层（DLLP）
DLLP类型 · ACK/NAK重传机制 · 流量控制（信用量）
PCIeDLLP
06
PCIe物理层基础
电气特性（差分信号） · 8b/10b编码（Gen1/2）与1…
PCIe物理层基础
07
链路训练状态机（LTSSM）概览
LTSSM状态图 · 从Detect到L0的典型路径
LTSSM链路训练状态机
08
LTSSM状态详解－检测阶段
Detect状态——检测对端设备 · 电气空闲退出
LTSSM状态详解－检测阶…
09
LTSSM状态详解－轮询阶段
Polling状态——发送TS1/T… · 位锁定与符号锁定
LTSSM状态详解－轮询阶…
10
LTSSM状态详解－配置阶段
Configuration状态——链… · 速率协商 · 极性翻转
LTSSM状态详解－配置阶…
11
LTSSM状态详解－恢复阶段
Recovery状态——重新训练 · 速率降级 · 链路宽度降级
LTSSM状态详解－恢复阶…
12
LTSSM状态详解－活动状态
L0正常数据传输 · L0s/L1低功耗状态 · L2/L3休眠状态
LTSSM状态详解－活动状…
13
链路训练关键序列
TS1和TS2 Ordered Se… · 字段含义（速率ID · 链路编号等）
链路训练关键序列TS1
14
链路宽度与速率协商过程
Gen1→Gen2→Gen3的速率升… · 宽度降级原因
链路宽度速率协商过程
15
链路训练失败常见原因
时钟抖动用余量不足 · 信号完整性差 · 电源噪声
链路训练失败常见…时钟抖动用余量不…
16
调试工具与方法
逻辑分析仪 · PCIe协议分析仪（如Teledyn… · 示波器探测差分信号
调试工具逻辑分析仪
17
使用协议分析仪捕获训练序列
设置触发条件 · 捕获TS1/TS2 · 解析训练过程
使用协议分析仪捕…设置触发条件
18
通过寄存器查看LTSSM状态
访问配置空间中的链路状态寄存器（Li…
LTSSM通过寄存器查看
19
搭建链路训练复现环境
FPGA开发板（Xilinx/Int… · PCIe IP核配置 · 仿真平台选择
搭建链路训练复现…FPGA
20
复现Detect状态
编写测试代码模拟电气空闲退出 · 检测对端存在的逻辑
Detect复现
21
复现Polling状态
生成并发送TS1序列 · 实现位锁定与符号锁定机制
Polling复现
22
复现Configuration状态
实现链路宽度协商 · 速率协商 · 极性调整
Configuratio…复现
23
复现Recovery状态
模拟链路错误导致重新进入Recove… · 降级过程
Recovery复现
24
复现L0状态与数据传输
建立稳定链路后发送TLP · 验证数据完整性
L0复现
25
异常情况复现
链路断开（Hot Reset） · 链路重训练（Link Retrain… · L0s进入与退出
异常情况复现Hot
26
使用仿真工具（Vivado Simulator / Questa）进行LTSSM
使用仿真工具（Vivado Simula… · 核心概念 · 实践要点
VivadoSimulator
27
实战案例一
某服务器项目链路只能工作在Gen1宽…
实战案例一Gen1
28
实战案例二
高速背板链路训练不稳定——信号完整性…
实战案例二高速背板链路训练…
29
高级话题
PCIe Gen4/Gen5链路训练… · Preset系数调优
高级话题PCIe
30
总结与进阶资源
推荐书籍（PCI Express S… · 开源PCIe控制器项目 · 调试方法论
进阶资源PCI