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eDP面板像素时钟与显示时序约束设计

共计 30 章节
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01
eDP简介
什么是eDP · 发展历史 · 在显示接口中的地位
eDP简介
02
eDP接口物理层
差分信号 · 主链路 · AUX通道
eDP接口物理层
03
eDP标准概述
VESA规范 · 版本演进（1.2/1.3/1.4/1…
eDP标准概述
04
视频时序基础
行同步 · 场同步 · 消隐区
视频时序基础行同步
05
时序参数详解
Hactive · HFP · HBP
时序参数详解Hactive
06
像素时钟频率计算
由分辨率和刷新率推导像素时钟
像素时钟频率计算由分辨率
07
数据通道（Lane）数量选择
1/2/4 Lane · 与带宽的对应关系
Lane数据通道
08
链路速率计算
RBR · HBR · HBR2
链路速率计算RBR
09
时钟抖动与相位噪声
定义 · 来源 · 对eDP链路的影响
时钟抖动相位噪声
10
时序约束基本概念
建立时间 · 保持时间 · 时钟偏差
时序约束基本概念建立时间
11
源同步与时钟恢复
eDP中时钟嵌入数据 · CDR原理
源同步时钟恢复
12
主链路电气参数
摆幅 · 预加重 · 均衡
主链路电气参数摆幅
13
训练序列与链路训练
训练过程 · Pattern生成 · 失败恢复
训练序列链路训练
14
动态背光控制（PSR）
时序要求 · SR机制
PSR动态背光控制
15
时序参数与分辨率关系
为什么4K@60需要更高带宽
时序参数分辨率关系
16
常用测量工具
示波器 · 逻辑分析仪 · 协议分析仪
常用测量工具示波器
17
使用示波器测量时序参数
探测方法 · 触发设置 · 测量项解读
使用示波器测量时…探测方法
18
SDC约束文件基础
create_clock · set_input_delay · set_output_delay
SDC约束文件基础
19
IO延时约束
输入延时与输出延时的计算方法
IO延时约束
20
时钟约束创建
主时钟 · 生成时钟 · 虚拟时钟
时钟约束创建主时钟
21
多周期路径约束
跨时钟域 · 慢速/快速时钟
多周期路径约束跨时钟域
22
伪路径约束
异步信号处理 · 不关心的路径
伪路径约束异步信号处理
23
时序分析工具入门
PrimeTime/Temps基本流…
时序分析工具入门PrimeTime/Te…
24
时序报告解读
slack · required time · data arrival time
时序报告解读slack
25
常见时序违例修复
调整约束 · 加流水线 · 优化路径
常见时序违例修复调整约束
26
eDP链路训练时序
训练阶段下的时序参数变化
eDP链路训练时序
27
实战1
给定1920×1080@60Hz · 计算所有时序参数
实战1Hz
28
实战2
基于FPGA编写eDP TX示例的约…
实战2FPGA
29
实战3
分析实际eDP接口时序报告 · 定位违例
实战3eDP
30
实战4
调试PPA场景下的动态时序调整
实战4PPA