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JESD204B物理链路层配置与CGS/ILAS调试

共计 30 章节
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01
JESD204B概述
发展历程 · 与JESD204A/204C的区别 · 典型应用场景
JESD204B发展历程
02
协议分层模型总览
应用层 · 传输层 · 数据链路层
协议分层模型总览应用层
03
物理层（PHY）基础
SerDes · CML驱动器 · 接收等化
PHY物理层
04
物理层关键参数
线速率 · 预加重/去加重 · 眼图模板
物理层关键参数线速率
05
数据链路层（Data Link Layer）功能
帧结构 · 多帧 · 控制字符与对齐字符
DataLink
06
数据链路层状态机
代码组同步（CGS） · 初始通道对齐序列（ILAS） · 用户数据状态
数据链路层状态机CGS
07
代码组同步（CGS）详解
同步请求 · 同步确认 · 逗号字符K28.5的作用
CGS代码组同步
08
初始通道对齐序列（ILAS）
多帧结构 · 配置参数加载 · 链路延迟测量
ILAS初始通道对齐序列
09
用户数据状态
正常数据传输 · 空闲帧 · 错误检测与处理
用户数据状态正常数据传输
10
传输层（Transport Layer）功能
样本打包 · 通道映射 · 样本尺寸与填充
TransportLayer
11
传输层配置参数
S（每帧样本数） · F（每帧字节数） · K（每多帧帧数）
传输层配置参数S
12
应用层（Application Layer）与JESD204B接口
ADC/DAC的数据格式 · 控制信号
ApplicationLayer
13
链路参数详解（一）
L（通道数） · M（转换器数） · N（样本分辨率）
链路参数详解L
14
链路参数详解（二）
N‘（总样本比特数） · CS（控制比特数） · CF（控制帧数）
链路参数详解N‘
15
帧与多帧结构
帧时钟 · 多帧时钟 · 帧起始与结束边界
多帧结构帧时钟
16
确定性延迟（Deterministic Latency）
原理 · 测量方法 · SYSREF与弹性缓冲
Deterministi…Latency
17
SYSREF信号详解
用途 · 时序要求 · 与本地多帧时钟的对齐
SYSREF信号详解
18
时钟架构
器件时钟（Device Clock） · SYSREF · 帧时钟
时钟架构Device
19
链路同步流程
从初始化到数据锁定的完整状态机跳转
链路同步流程从初始化到数据锁…
20
错误处理机制
8B/10B编码错误 · 越界错误 · 链路失锁恢复
错误处理机制B/10B
21
8B/10B编码在JESD204B中的应用
控制字符 · 数据字符 · 游程长度控制
B/10BJESD204B
22
通道对齐与斜移补偿
ILAS中的通道对齐 · 弹性缓冲延迟调整
通道对齐斜移补偿
23
多链路配置
如何将多个JESD204B链路用于多…
多链路配置JESD204B
24
子类（Subclass）详解
Subclass 0/1/2的差别 · 确定性延迟支持情况
Subclass子类
25
Subclass 1详解
SYSREF必须 · 延迟测量原理 · 实际设计要点
Subclass1详解
26
Subclass 2详解
不使用SYSREF · 利用SYNC~进行延迟对齐 · 局限性
Subclass2详解
27
寄存器编程与配置
常用SPI寄存器举例 · 链路建立步骤
寄存器编程配置
28
链路预算与信号完整性
PCB布线要求 · 线速率与损耗 · 连接器选型
链路预算信号完整性
29
测试与调试
眼图测试 · 链路状态监测 · 常见问题排查（误码
测试调试
30
设计实例
基于JESD204B的ADC采集系统…
设计实例JESD204B