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PCIe TS1/TS2协议解码与链路训练

共计 30 章节

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PCIe协议概述与TS1/TS2的作用

介绍PCIe体系结构 · 链路训练的必要性 · 以及TS1/TS2在链路初始化

PCIe物理层基础

差分信号 · 8b/10b编码 · 帧格式与符号结构

PCIe物理层基础

链路训练状态机（LTSSM）入门

讲解Detect · Polling · Configuration等状态

LTSSM链路训练状态机

TS1训练序列格式解析

详细分析TS1的各个字段（SYNC · COM · TS1 Identifier

TS1训练序列格式解析

TS2训练序列格式解析

对比TS1 · 说明TS2的字段差异及其在配置阶段的…

TS2训练序列格式解析

TS1/TS2中的链路编号与链路号

如何定义链路编号 · 链路号的含义 · 以及它们在多链路协商中的使用

TS1/TS2链路编号

速率协商机制

TS1/TS2如何传递速率能力 · 以及如何进行升速/降速协商

速率协商机制TS1/TS2

位锁定与符号锁定

TS1/TS2中的同步序列如何帮助接…

位锁定符号锁定

时钟恢复与CDR

从TS1/TS2中提取参考时钟的方法 · 常见CDR电路原理

CDR时钟恢复

捕获TS1/TS2数据包的方法

使用逻辑分析仪 · PCIe分析仪或示波器抓取物理层信号

手动解码TS1/TS2

通过二进制位流分析 · 逐字段解读一个真实的TS1/TS2帧

TS1/TS2手动解码

使用Wireshark解码TS1/TS2

配置PCIe分析捕获 · 在Wireshark中过滤和查看训练…

WiresharkTS1/TS2

专用解码工具介绍

PEXPEX · PEX 8600工具 · PCIe Scanner等工具的使用…

专用解码工具介绍PEXPEX

TS1/TS2在链路初始化中的时序

从Detect到L0状态 · 各阶段TS1/TS2的发送间隔和数量

TS1/TS2链路初始化

TS1/TS2在链路恢复过程中的作用

在L0s · L1 · L2等低功耗状态恢复时如何重发训练序…

TS1/TS2链路恢复过程

区分TS1和TS2的方法

通过Identifier字段 · 序列长度 · 携带的配置信息来区分

训练控制字段解码

分析Training Control… · 禁用 · 均衡等标志位

训练控制字段解码Training

链路训练参数解码

解释Speed Change · Lane Width · Enhanced Span等参数的实…

链路训练参数解码Speed

实际案例分析

分析一次完整的PCIe扫描过程 · 抓取并解码TS1/TS2序列 · 还原链路协商过程

实际案例分析PCIe

常见解码错误与排查

位错位 · 同步丢失 · 极性错误等问题及处理办法

常见解码错误排查

链路宽度协商中的TS1/TS2

如何通过训练序列宣告支持的lane数… · 以及最终宽度确定

TS1/TS2链路宽度协商

链路翻转（Lane Reversal）与极性反转

TS1/TS2如何检测并纠正物理层接…

PCIe Replay机制与TS1/TS2

当链路异常时 · 接收端通过TS2请求重传训练序列

TS1/TS2在PCIe Gen3/… · EQ训练等

高级话题TS1/TS2

使用FPGA实时解码TS1/TS2

设计Verilog解码器 · 在硬件上捕获并解析训练序列

编写Python脚本自动化解码

读取二进制捕获文件 · 解析字段 · 生成可视化报告

解码结果的验证与调试

对比规范文档 · 检查预设能力与解码结果是否一致

解码结果的验证调试

如何通过修改TS1/TS2中的参数加…

性能优化TS1/TS2

常见实战问题

PCIe链路不稳定 · 无法识别设备时的TS1/TS2特征分…

常见实战问题PCIe

总结与展望

TS1/TS2解码在PCIe开发与调… · 以及未来PCIe标准对训练序列的演进