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EDA工具链Cadence Genus逻辑综合优化入门到精通

共计 30 章节
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01
课程导入
学习目标 · 课程大纲 · Cadence Genus在数字IC…
课程导入学习目标
02
逻辑综合基础
逻辑综合的基本概念 · RTL到门级网表的转换流程 · 综合的输入输出文件
逻辑综合基础逻辑综合的基本概…
03
环境搭建与工具启动
Cadence Genus的安装配置 · 许可证设置 · 启动方式
环境搭建工具启动
04
设计读入与网表输出
读取RTL · 约束文件 · 库文件的方法
设计读入网表输出
05
标准单元库与工艺库
理解.lib · .db · .lef等库文件格式
标准单元库工艺库
06
约束编写基础
SDC约束文件的语法 · 时钟定义 · 输入输出延迟
约束编写基础SDC
07
综合策略与流程控制
综合策略（top-down · bottom-up） · 综合流程脚本编写
综合策略流程控制
08
时序分析与优化
建立时间 · 保持时间 · 时序路径分析
时序分析优化
09
面积优化
面积评估 · 面积优化策略 · 资源共享
面积优化面积评估
10
功耗优化
功耗来源分析 · 低功耗综合技术（门控时钟 · 操作数隔离
功耗优化功耗来源分析
11
综合质量报告解读
时序报告 · 面积报告 · 功耗报告
综合质量报告解读时序报告
12
综合优化选项详解
compile_ultra · retiming · 寄存器重定时
综合优化选项详解compile
13
多模式多角分析
MMMC设置 · 不同工作模式与工艺角下的约束与优化 · 确保设计鲁棒性
多模式多角分析MMMC
14
层次化综合与物理感知综合
层次化设计划分 · 物理约束传递 · 物理感知综合的优势与流程
层次化综合物理感知综合
15
DFT综合集成
可测试性设计（扫描链插入 · BIST）与逻辑综合的协同 · DFT约束与验证
DFT综合集成
16
低功耗设计流程
UPF/CPF低功耗意图文件 · 电源域划分 · 电平转换
低功耗设计流程UPF/CPF
17
综合与后端衔接
网表输出给布局布线工具 · 时序收敛的交接 · 与Innovus等工具的接口
综合后端衔接
18
脚本自动化与Tcl编程
Genus中Tcl脚本编写技巧 · 变量 · 循环
Tcl脚本自动化
19
综合优化实战案例一
基于一个简单RTL设计 · 完成从读入到综合优化的完整流程
综合优化实战案例…RTL
20
综合优化实战案例二
针对一个复杂模块 · 进行时序 · 面积
综合优化实战案例…针对一个复杂模块
21
综合优化实战案例三
多时钟域设计综合 · 处理异步时钟 · 时钟门控
综合优化实战案例…多时钟域设计综合
22
常见问题与调试技巧
综合错误 · 警告信息解析 · 时序违例
常见问题调试技巧
23
综合性能提升
并行综合 · 分布式综合 · 多核加速
综合性能提升并行综合
24
与前端验证的协同
RTL仿真与综合后仿真的一致性检查 · 形式化验证在综合中的应用
前端验证的协同RTL
25
综合库的定制与建模
自定义单元库 · 时序模型建模 · 库特征化对综合结果的影响
综合库的定制建模
26
先进工艺节点下的综合挑战
FinFET · 纳米工艺下的时序 · 功耗
先进工艺节点下的…FinFET
27
综合与机器学习结合
机器学习在时序预测 · 优化策略选择中的应用 · Genus中的智能优化功能
综合机器学习结合
28
综合流程管理
版本控制 · 回归测试 · 流程标准化
综合流程管理版本控制
29
综合优化高级专题
时钟树综合预优化 · 电压降感知综合 · 信号完整性对综合的影响
综合优化高级专题时钟树综合预优化
30
课程总结与项目实战
综合所有知识 · 完成一个完整芯片模块的综合优化项目 · 并撰写报告
课程总结项目实战