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drm_encoder驱动中LVDS时钟配置与链路训练

共计 30 章节
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01
LVDS接口概述
LVDS物理层原理 · 差分信号特性 · LVDS在显示接口中的应用场景
LVDS接口概述
02
DRM Encoder驱动框架
DRM核心数据结构 · Encoder的注册与回调函数 · LVDS Encoder的初始化流程
DRMEncoder
03
LVDS时钟基础
像素时钟(PCLK) · 链路时钟(LCLK)的关系 · 时钟频率计算公式
LVDS时钟基础
04
时钟树与PLL配置
SoC内部时钟树结构 · PLL分频/倍频原理 · LVDS时钟源选择
PLL时钟树
05
LVDS数据映射模式
JEIDA与VESA映射标准 · 数据通道分配 · RGB位序与映射寄存器配置
LVDS数据映射模式
06
链路训练概念
链路训练的目的 · 训练序列结构 · 训练状态机(Link Trainin…
链路训练概念链路训练的目的
07
训练序列生成
时钟通道训练码型 · 数据通道训练码型 · 码型生成硬件逻辑
训练序列生成时钟通道训练码型
08
接收端训练响应
接收端均衡器调整 · CDR锁定过程 · 训练成功/失败判定条件
接收端训练响应接收端均衡器调整
09
时钟抖动与眼图
时钟抖动分类(TJ/RJ/DJ) · 眼图张开度要求 · 抖动容限测试方法
时钟抖动眼图
10
LVDS预加重与去加重
预加重原理 · 去加重配置寄存器 · 信号完整性优化策略
LVDS预加重
11
链路训练参数配置
训练次数 · 超时时间 · 电压摆幅
链路训练参数配置训练次数
12
DRM Bridge与LVDS Encoder
Bridge驱动模型 · LVDS Bridge芯片(如SN6…
DRMBridge
13
设备树绑定
LVDS节点属性 · 时钟与GPIO描述 · panel-timing节点解析
设备树绑定LVDS
14
时钟频率动态切换
双速率模式 · 降频模式 · 时钟频率切换时的链路重训练
时钟频率动态切换双速率模式
15
训练失败处理机制
重训练策略 · 降级模式(降通道数/降分辨率) · 错误上报与日志
训练失败处理机制重训练策略
16
LVDS多通道同步
多通道对齐 · 通道间skew补偿 · 训练同步序列设计
LVDS多通道同步
17
功耗管理
LVDS PHY电源门控 · 时钟门控 · 训练状态下的低功耗模式
功耗管理LVDS
18
调试与测试工具
示波器测量LVDS信号 · 逻辑分析仪抓取训练序列 · 内核调试fs接口
调试测试工具
19
常见问题与排查
黑屏/花屏/闪屏的时钟原因 · 训练超时案例分析 · 寄存器dump分析
常见问题排查
20
LVDS与eDP对比
信号特性差异 · 训练协议差异 · 驱动实现复杂度对比
LVDSeDP
21
硬件设计要点
PCB走线等长要求 · 终端匹配电阻 · 共模扼流圈选型
硬件设计要点PCB
22
训练序列自定义
厂商特定训练码型 · 自定义训练状态机扩展方法
训练序列自定义厂商特定训练码型
23
多显示器支持
独立LVDS通道配置 · 时钟域隔离 · 同步训练策略
多显示器支持LVDS
24
热插拔与训练
热插拔检测机制 · 热插拔后的链路重训练流程 · 电容耦合影响
热插拔训练
25
EMI/EMC考虑
展频时钟(SSC)配置 · LVDS信号频谱优化 · 屏蔽与滤波设计
EMI/EMC考虑
26
固件与驱动协作
Bootloader初始化LVDS · 内核驱动接管流程 · 固件训练状态传递
固件驱动协作
27
性能优化
训练时间优化 · 寄存器批量读写 · DMA辅助训练序列发送
性能优化训练时间优化
28
安全与合规
LVDS信号等级安全 · IEC 62368-1合规要求 · 训练失败安全降级
安全合规
29
未来趋势
LVDS向FPD-Link演进 · 车载LVDS高可靠性要求 · MIPI DSI转LVDS桥接
未来趋势LVDS
30
综合实战案例
基于i.MX8M Plus的LVDS… · 时钟配置与链路训练完整实现
综合实战案例i.MX8M